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參數(shù)資料
| 型號(hào)： | TSB42AA4PDT |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | IEEE 1394 A CONSUMER ELECTRONICS LINK LAYER CONTROLLER |
| 中文描述： | 1394消費(fèi)電子產(chǎn)品鏈路層控制器 |
| 文件頁數(shù)： | 46/183頁 |
| 文件大?。?/td> | 798K |
| 代理商： | TSB42AA4PDT |
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321
ceLynx always generates the clock at the SCL line. The data at the SDA line has to be changed in the low
phase of the clock only. Changing the SDA line in the clock-high-phase is interpreted as start- or
stop-condition.
The first byte sent by ceLynx is the device address of the EEPROM. The data transfer begins with 8 bits
of data and a 1-bit ACK. The ACK is given by the receiving unit. ceLynx generates a
stop-condition
to end
the communication.
Start/Stop-Condition
SDA
Timing: Data-Transfer and Acknowledge
Start-
Condition
Stop-
Condition
SCL
SCL from Master
Data from Transmitter
Data from Receiver
1
ACK
LSB
MSB
9
8
2
Figure 326. Two-Wire Serial Interface Bus Protocol
3.4.2
ceLynx/Two-Wire Serial-Interface EEPROM Protocol
Definitions:
MASTER: ceLynx
SLAVE: EEPROM
0 1
1
0
0
0 0 d
Read (1)
Write (0)
MSB
LSB
Device-Address Format
Figure 327. EEPROM Protocol Device Address Format
This operation sets the internal address counter of the EEPROM. Any read operation after that starts at the
specified address.
Typical Read Operation
Start
1 0
S
0
1
0 0 0
A
1
A
A
P
N
Device-Address
and Read
1st data byte
2nd data byte
nth (last) data byte
Slave
Master
ACK
read
ACK
ACK
Stop
no ACK
Figure 328. EEPROM Protocol Typical Read Operation
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| TSB42AB4I | IEEE 1394 A CONSUMER ELECTRONICS LINK LAYER CONTROLLER |
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參數(shù)描述 |
|---|---|
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| TSB42AA4PDTR | 制造商:Texas Instruments 功能描述: |
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| TSB42AA9 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:STORAGELYNX 1394 LINK-LAYER CONTROLLER FOR ATA/ATAPI STORAGE PRODUCTS |
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