參數(shù)資料
型號: STP2202ABGA
元件分類: 微控制器/微處理器
英文描述: SPECIALTY MICROPROCESSOR CIRCUIT, PBGA320
封裝: BGA-320
文件頁數(shù): 71/106頁
文件大?。?/td> 519K
代理商: STP2202ABGA
67
Dual Processor System Controller
DSC
STP2202ABGA
June 1998
Sun Microsystems, Inc
Figure 48. 10 NSec Read Timing
-1
0
1
2
3
4
5
6
7
8
10 nsec UPA values
READS
910
Bank 0
Bank 1
11
Cycle ends at 11
12
RAS path: SCMP ckl to out = 6 ; measured wire and SIMM buffer delay (resistor to DRAM) = 9; total = 15ns
Data path: measured wire and CBT delay (DRAM to BMX) = 4 ; BMX setup = 4ns; total = 8ns
GRAND TOTAL: add 19 ns to all DRAM access times.
80 (60)
60 (30)
Limiting factor is RAS to data: 1 ns margin
Measured 12/20; RAS: SCMP UPA Clk+ to DRAM = 7.8; ADDR: 8.65; DATA: BMX UPA Clk+ to DRAM = 7.
100 MHz screen on SCMP and BMX give + 4 Nsec margin on above path; 2 on SCMP clk to out, 2 on BMX
this is 23 @ 12nsec
0ns
50ns
100ns
clk1
BMX-MP cmd
MRB-ctrl
wr/
RAS/
ROW
CAS0/
CAS1/
BankSel
DRAM Data
PingPong
Stretch
Same Rd-Ref
Same Rd-Rd
Same Rd-Wr
Dif Rd-Ref
Dif Rd-Rd
Dif Rd-Wr
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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