- 您現(xiàn)在的位置：買賣IC網 > PDF目錄380715 > ST72T631K2M0 (意法半導體) LOW SPEED USB 8-BIT MCU FAMILY with up to 16K MEMORY, up to 512 BYTES RAM, 8-BIT ADC, WDG, TIMER, SCI & I2C PDF資料下載
參數資料
| 型號： | ST72T631K2M0 |
| 廠商： | 意法半導體 |
| 英文描述： | LOW SPEED USB 8-BIT MCU FAMILY with up to 16K MEMORY, up to 512 BYTES RAM, 8-BIT ADC, WDG, TIMER, SCI & I2C |
| 中文描述： | 低速USB 8高達16K的內存位微控制器系列，高達512字節(jié)RAM，8位ADC，水分散粒劑，定時器，SCI |
| 文件頁數： | 66/109頁 |
| 文件大?。?/td> | 857K |
| 代理商： | ST72T631K2M0 |
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ST7263
66/109
USB INTERFACE
(Cont’d)
5.6.4 Register Description
DMA ADDRESS REGISTER (DMAR)
Read / Write
Reset Value: Undefined
Bits 7:0=
DA[15:8]
DMA address bits 15-8.
Software must write the start address of the DMA
memory area whose most significant bits are given
by DA15-DA6. The remaining 6 address bits are
set by hardware. See the description of the IDR
register and
Figure 2
.
INTERRUPT/DMA REGISTER (IDR)
Read / Write
Reset Value: xxxx 0000 (x0h)
Bits 7:6 =
DA[7:6]
DMA address bits 7-6.
Software must reset these bits. See the descrip-
tion of the DMAR register and
Figure 2
.
Bits 5:4 =
EP[1:0]
Endpoint number
(read-only).
These bits identify the endpoint which required at-
tention.
00: Endpoint 0
01: Endpoint 1
10: Endpoint 2
When a CTR interrupt occurs (see register ISTR)
the software should read the EP bits to identify the
endpoint which has sent or received a packet.
Bits 3:0 =
CNT[3:0]
Byte count
(read only).
This field shows how many data bytes have been
received during the last data reception.
Note:
Not valid for data transmission.
Figure 37. DMA Buffers
7
0
DA15
DA14
DA13
DA12
DA11
DA10
DA9
DA8
7
0
DA7
DA6
EP1
EP0
CNT3
CNT2
CNT1
CNT0
Endpoint 0 RX
Endpoint 0 TX
Endpoint 2 RX
Endpoint 1 TX
000000
000111
001000
001111
010000
010111
011000
011111
DA15-6,000000
Endpoint 1 RX
Endpoint 2 TX
100000
100111
101000
101111
相關PDF資料 |
PDF描述 |
|---|---|
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