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參數(shù)資料
| 型號(hào)： | ST72T631K2M0 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | LOW SPEED USB 8-BIT MCU FAMILY with up to 16K MEMORY, up to 512 BYTES RAM, 8-BIT ADC, WDG, TIMER, SCI & I2C |
| 中文描述： | 低速USB 8高達(dá)16K的內(nèi)存位微控制器系列，高達(dá)512字節(jié)RAM，8位ADC，水分散粒劑，定時(shí)器，SCI |
| 文件頁數(shù)： | 31/109頁 |
| 文件大?。?/td> | 857K |
| 代理商： | ST72T631K2M0 |
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ST7263
31/109
I/O PORTS
(Cont’d)
5.1.7 Register Description
DATA REGISTERS (PxDR)
Port A Data Register (PADR): 0000h
Port B Data Register (PBDR): 0002h
Port C Data Register (PCDR): 0004h
Read/Write
Reset Value Port A: 0000 0000 (00h)
Reset Value Port B: 0000 0000 (00h)
Reset Value Port C: 1111 x000 (FXh)
Note:
for Port C, unused bits (7-3) are not acces-
sible.
Bit 7:0 = D7-D0
Data Register 8 bits.
The DR register has a specific behaviour accord-
ing to the selected input/output configuration. Writ-
ing the DR register is always taken in account
even if the pin is configured as an input. Reading
the DR register returns either the DR register latch
content (pin configured as output) or the digital val-
ue applied to the I/O pin (pin configured as input).
DATA DIRECTION REGISTER (PxDDR)
Port A Data Direction Register (PADDR): 0001h
Port B Data Direction Register (PBDDR): 0003h
Port C Data Direction Register (PCDDR): 0005h
Read/Write
Reset Value Port A: 0000 0000 (00h)
Reset Value Port B: 0000 0000 (00h)
Reset Value Port C: 1111 x000 (FXh)
Note:
for Port C, unused bits (7-3) are not acces-
sible
Bit 7:0 = DD7-DD0
Data Direction Register 8 bits.
The DDR register gives the input/output direction
configuration of the pins. Each bits is set and
cleared by software.
0: Input mode
1: Output mode
Table 13. I/O Ports Register Map
7
0
D7
D6
D5
D4
D3
D2
D1
D0
7
0
DD7
DD6
DD5
DD4
DD3
DD2
DD1
DD0
Address
(Hex.)
00
01
02
03
04
05
Register
Label
PADR
PADDR
PBDR
PBDDR
PCDR
PCDDR
7
6
5
4
3
2
1
0
MSB
MSB
MSB
MSB
MSB
MSB
LSB
LSB
LSB
LSB
LSB
LSB
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PDF描述 |
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