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參數(shù)資料
| 型號(hào)： | ST72T631K2M0 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | LOW SPEED USB 8-BIT MCU FAMILY with up to 16K MEMORY, up to 512 BYTES RAM, 8-BIT ADC, WDG, TIMER, SCI & I2C |
| 中文描述： | 低速USB 8高達(dá)16K的內(nèi)存位微控制器系列，高達(dá)512字節(jié)RAM，8位ADC，水分散粒劑，定時(shí)器，SCI |
| 文件頁(yè)數(shù)： | 32/109頁(yè) |
| 文件大?。?/td> | 857K |
| 代理商： | ST72T631K2M0 |
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ST7263
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5.2 MISCELLANEOUS REGISTER
Address: 0009h
Reset Value: 1111 0000 (F0h)
—
Read/Write
Bit 7:4 = Reserved
Bit 3 =
LVD
Low Voltage Detector.
This bit is set by software and only cleared by hard-
ware after a reset.
0: LVD enabled
1: LVD disabled
Bit 2 =
CLKDIV
Clock Divider
.
This bit is set by software and only cleared by hard-
ware after a reset. If this bit is set, it enables the use
of a 12 MHz external oscillator (refer to
Figure 10
on page 17
).
0: 24 MHz external oscillator
1: 12 MHz external oscillator.
Bit 1 =
USBOE
USB enable.
If this bit is set, the port PC2 outputs the USB out-
put enable signal (at “1” when the ST7 USB is
transmitting data).
Unused bits 7-4 are set.
Bit 0 =
MCO
Main Clock Out selection
This bit enables the MCO alternate function on the
PA0 I/O port. It is set and cleared by software.
0: MCO alternate function disabled (I/O pin free for
general-purpose I/O)
1: MCO alternate function enabled (f
CPU
on I/O
port)
7
0
-
-
-
-
LVD
CLKDIV USBOE
MCO
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PDF描述 |
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參數(shù)描述 |
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