參數(shù)資料
型號(hào)： SBPH400-3
廠商： 意法半導(dǎo)體
英文描述： IEEE1394 3-Port 400Mbps Physical Layer
中文描述： IEEE1394連接3端口400Mbps的物理層
文件頁(yè)數(shù)： 39/43頁(yè)
文件大?。?/td> 285K
代理商： SBPH400-3
SBPH400-3
39/43
Table 5.2
AC characteristics (digital interfaces)
Symbol Parameter
t
psu
Measured
50% to 50%
Condition Unit
Min
6
Typ
Max
D, CTL, LREQ input setup to SCLK
output
D, CTL, LREQ hold from SCLK output 50% to 50%
D, CTL output setup to SCLK
D, CTL output hold from SCLK
Delay time, SCLK input high to initial
instances of D, CTL and LREQ
outputs valid
Delay time, SCLK input high to
subsequent instances of D, CTL and
LREQ outputs valid
Delay time, SCLK input high to D,CTL
and LREQ outputs invalid (tri-state)
ns
t
ph
t
lsu
t
lh
t
d1
ns
ns
ns
ns
0
50% to 50%
50% to 50%
50% to 50%
6.5
0.5
1
10
t
d2
50% to 50%
ns
1
10
t
d3
50% to 50%
ns
1
10
Table 5.3
Clock and reset parameters
Symbol Parameter
Fextclk
Dextclk
Jextclk
F
SCLK
D
SCLK
Measured
Condition Unit
Min
Typ
Max
External clock Frequency
External clock duty cycle
External clock Jitter peak to peak
SCLK frequency
SCLK duty cycle
Power-on reset time, RESET# input
24.576 MHz +/- 2.45 KHz
45%
100 pS peak to peak
Fextclk
×
2
45%
ms
2
50% to 50%
55%
50% to 50%
50% to 50%
55%
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