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參數(shù)資料
| 型號： | PM73122-BI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PBGA352 |
| 封裝： | 35 X 35 MM, 1.51 MM HEIGHT, SBGA-352 |
| 文件頁數(shù)： | 58/489頁 |
| 文件大小： | 4416K |
| 代理商： | PM73122-BI |
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RELEASED
PM73122 AAL1GATOR-32
DATASHEET
PMC-1981419
ISSUE 7
32 LINK CES/DBCES AAL1 SAR PROCESSOR
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
33
Pin Name
Type
Pin
No.
Function
TL_CLK[15]/TSM[15]
TL_CLK[14]/TSM[14]
TL_CLK[13]/TSM[13]
TL_CLK[12]/TSM[12]
TL_CLK[11]/TSM[11]
TL_CLK[10]/TSM[10]
TL_CLK[9]/TSM[9]
TL_CLK[8]/TSM[8]
TL_CLK[7]/TSM[7]
TL_CLK[6]/TSM[6]
TL_CLK[5]/TSM[5]
TL_CLK[4]/TSM[4]
TL_CLK[3]/TSM[3]
TL_CLK[2]/TSM[2]
TL_CLK[1]/TSM[1]
TL_CLK[0]/TSM[0]
I/O
J25
N25
R25
T26
H26
J24
A15
C15
D6
C1
E1
H2
K2
T1
U3
Y2
Transmit Line Channel Clock 15 to 0 are
the clock lines for the sixteen lines. They
clock the data from the AAL1gator-32 to
the corresponding framer devices.
Depending on the value of the
TLCLK_OE pin and the
CLK_SOURCE_TX field in the
LIN_STR_MODE memory register, these
pins are either outputs or inputs. If
TLCLK_OUTPUT_EN is high, these pins
are outputs and the clock is sourced
internally at power up. This can later be
changed by the CLK_SOURCE_TX field.
Note that if CLK_SOURCE_TX /= “000”
then this pin is an output, even if it is not
driving a clock. A clock will only be driven
if in E1 or T1 mode and either the internal
clock synthesizer is being used or the
clock is being looped. CLK_SOURCE_TX
= “001”, “010, “011”, “100”, or “101”)
Note that if UDF_HS=1 in the
HS_LIN_REG, TL_CLK[7:1] should be
tied high.
Transmit Signaling Mirror is a copy of the
TL_SIG output. In Direct Low Speed
mode, if CLK_SOURCE_TX=”111” then
signaling is output on this pin. This option
is used with devices that share the same
pin for clock and signaling. In this mode
CTL_CLK is used as the line clock.
Maximum output current (IMAX) = 6 mA.
CTL_CLK
Input
C8
Common Transmit Line Clock is a
transmit line clock which can be shared
across all lines. Whether this clock is
used or not for a given line is dependent
on the value of CLK_SOURCE_TX in the
LINE_STR_MODE memory register for
that line.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM73123 | 8 LINK CES/DBCES AAL1 SAR |
| PM73123-PI | 8 LINK CES/DBCES AAL1 SAR |
| PM73124 | 4 Link CES/DBCES AAL1 SAR |
| PM7323 | ROUTING CONTROL, MONITORING, & POLICING 200 MBPS |
| PM7323-SI | ROUTING CONTROL, MONITORING, & POLICING 200 MBPS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM73122-BIP | 制造商:PMC-Sierra 功能描述:AAL1GATOR32 EOL270906 |
| PM73122-BI-P | 制造商:PMC-Sierra 功能描述: |
| PM73123 | 制造商:PMC 制造商全稱:PMC 功能描述:8 Link CES/DBCES AAL1 SAR |
| PM73123PI | 制造商:PMC-Sierra 功能描述: |
| PM73123-PI | 制造商:PMC 制造商全稱:PMC 功能描述:8 LINK CES/DBCES AAL1 SAR |
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