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參數(shù)資料
| 型號： | PM73122-BI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PBGA352 |
| 封裝： | 35 X 35 MM, 1.51 MM HEIGHT, SBGA-352 |
| 文件頁數(shù)： | 432/489頁 |
| 文件大?。?/td> | 4416K |
| 代理商： | PM73122-BI |
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RELEASED
PM73122 AAL1GATOR-32
DATASHEET
PMC-1981419
ISSUE 7
32 LINK CES/DBCES AAL1 SAR PROCESSOR
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
407
15.2 Sink Utopia
In ATM master mode, the SNK_INTF block receives RATM_DATA, RATM_PAR,
RATM_SOC, and RATM_CLAV while driving RATM_ENB. During reset the
SNK_INTF tristates the RATM_ENB (and all other SRC_INTF outputs). After the
end of reset and after UI_EN in the UI_COMN_CFG register is set, if the
RATM_CLAV input signal is not asserted the SNK_INTF waits and RATM_ENB
is deasserted high. As shown in Figure 101, once the RATM_CLAV input signal
is asserted, the RATM_RENB output signal is asserted low 2 cycles later and it is
expected that the PHY slave will deliver the first data byte one cycle after RENB
goes low. Typically a start-of-cell signal will be sent by the PHY slave along with
the first byte of data, however RATM_SOC is optional and the RATM_SOC input
could be tied low. Note however, not using an SOC eliminates the possibility of
runt cell detection. Once RATM_ENB goes low, a counter is started, and 53
bytes are expected. If an SOC occurs within a cell, the counter reinitializes and
the previous corrupted cell will be dropped and the second good cell will be
received. The SNK_INTF block stores the ATM cell in the receive FIFO. The 4
cell MCFF FIFO allows the interface to accept data at the maximum rate and if
the FIFO fills, the RATM_ENB signal will not be asserted again until
RATM_CLAV is asserted and the device is ready to accept an entire cell. The
maximum supported clock rate is 52 MHz.
Figure 101 SNK_INTF Start-of-Transfer Timing (Utopia 1 ATM Mode)
D1
D2
D3
D4
D5
D6
P1
P2
P3
P4
P5
P6
RATM_CLK(i)
RATM_CLAV(i)
RATM_SOC(i)
RATM_DATA(i)
RATM_PRTY(i)
RATM_ENB(o)
Note that in ATM master mode the SNK_INTF uses cell based handshaking, thus
once a transfer has begun, RATM_ENB will be asserted continuously until the
end of the cell regardless of the state of RATM_CLAV. Figure 102 shows the
end of transfer signal behavior. In this example, since the PHY slave does not
have another cell to deliver, the RATM_CLAV signal is deasserted after the last
byte is delivered. Also, the AAL1GATOR acting as an ATM master always
deasserts the RATM_ENB at the end of a cell transfer. RATM_CLAV is then
sampled again on the following clock cycle, and if asserted, RATM_ENB will be
asserted again for a new transfer.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM73123 | 8 LINK CES/DBCES AAL1 SAR |
| PM73123-PI | 8 LINK CES/DBCES AAL1 SAR |
| PM73124 | 4 Link CES/DBCES AAL1 SAR |
| PM7323 | ROUTING CONTROL, MONITORING, & POLICING 200 MBPS |
| PM7323-SI | ROUTING CONTROL, MONITORING, & POLICING 200 MBPS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM73122-BIP | 制造商:PMC-Sierra 功能描述:AAL1GATOR32 EOL270906 |
| PM73122-BI-P | 制造商:PMC-Sierra 功能描述: |
| PM73123 | 制造商:PMC 制造商全稱:PMC 功能描述:8 Link CES/DBCES AAL1 SAR |
| PM73123PI | 制造商:PMC-Sierra 功能描述: |
| PM73123-PI | 制造商:PMC 制造商全稱:PMC 功能描述:8 LINK CES/DBCES AAL1 SAR |
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