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參數(shù)資料
| 型號： | MB90242A |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 32 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, 0.50 MM PITCH, PLASTIC, SQFP-80 |
| 文件頁數(shù)： | 55/258頁 |
| 文件大?。?/td> | 2010K |
| 代理商： | MB90242A |
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2.10External Interrupts
143
(3) ELVR (Request Level Setting Register)
s Register Allocation
s Register Description
The ELVR register is used to select the mode of request detection. 2 bits are assigned to each pin, and
are set in combination as shown below. When the request input is in level, clearing the register setting
will reset the signal if the input is at active level.
Table 2.10.1 ELVR Bit Settings
2.10.4 Operating Description
(1) External Interrupt Operations
When external interrupt requests are used, this resource will generate an interrupt request signal to the
interrupt controller whenever an interrupt designated in the ELVR register is received at the corre-
sponding input pin. Interrupts generated simultaneously are assigned priority values by the interrupt
controller. If an interrupt from this resource has the current highest priority, the interrupt controller will
generate an interrupt request to the F2MC-16F CPU, which will compare the interrupt with the ILM bit
in its own internal CCR register. If the interrupt has a higher priority level than the ILM bit, the CPU
will start the hardware interrupt processing microprogram as soon as the current instruction being exe-
cuted is terminated.
Fig. 2.10.2 External Interrupt Operation
LBx
LAx
Detection mode
0
1
0
1
0
1
Interrupt if L level signal
Interrupt if H level signal
Interrupt if rising edge
Interrupt if falling edge
LB3
LA3
LB2
LA2
LB1
LA1
LB0
LA
Bit no.
Read/write
(R/W) (R/W) (R/W) (R/W) (R/W) (R/W) (R/W) (R/W)
Initial value
(0)
Request level setting register
Address : 000032H
7654
3
2
10
ELVR
External interrupt/DTP
Interrupt
Other requests
Interrupt controller
F2MC-16F CPU
ELVR
EIRR
ENIR
ICR yy
ICR xx
CMP
source
IL
ILM
CMP
INTA
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