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參數(shù)資料
| 型號(hào)： | MB90242A |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 32 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, 0.50 MM PITCH, PLASTIC, SQFP-80 |
| 文件頁數(shù)： | 48/258頁 |
| 文件大?。?/td> | 2010K |
| 代理商： | MB90242A |
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2.9 A/D Converter
136
[Bits 14, 13, 12] ACS2, ACS1, ACS0 (Analog channel set)
These bits are used to select the A/D conversion channel.
In single conversion mode, these bits change the channel selection.
In scan conversion mode, these bits select the scan start channel (see section 2.9.4 "Operating
Description").
When AN0to AN3 are selected, scan conversion will cover the selected channel through AN3.
When AN6 to AN7 are selected, scan conversion will cover the selected channel through AN7.
Results are stored in different registers depending on channels selected.
Note that the AN2 to AN3 and AN6 to AN7 data registers overlap.
When conversion on AN2 is followed by conversion on AN6, data will be overwritten causing loss
of the conversion data on AN2.
[Bits 11, 10] Not used
[Bit 9] CREG:
This bit is used to set the number of bits to save from A/D conversion (see section 2.9.3(4)).
0: 10-bit mode
The upper 2 bits of the conversion value are stored in the ADTHx register, and the lower 8 bits
in the ADTLx register.
1: 8-bit mode
The upper 8 bits of the conversion value are stored in the ADTLx register.
The initial value at reset is '0.'
[Bit 8] SCAN:
This bit selects the conversion mode.
The initial value after reset is '0.'
ACS2
ACS1
ACS0
Channel
Corresponding data register
0
AN0
ADTH0, ADTL0
0
1
AN1
ADTH1, ADTL1
0
1
0
AN2
ADTH2, ADTL2
0
1
AN3
ADTH3, ADTL3
1
0
Setting prohibited
–
1
0
1
Setting prohibited
–
1
0
AN6
ADTH2, ADTL2
1
AN7
ADTH3, ADTL3
Function
0
Single conversion mode
1
Scan conversion mode
相關(guān)PDF資料 |
PDF描述 |
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| MB90F352SPFV | 16-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP64 |
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