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參數(shù)資料
| 型號： | L64005-F |
| 廠商： | LSI CORP |
| 元件分類： | 消費家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP160 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 128/272頁 |
| 文件大?。?/td> | 1252K |
| 代理商： | L64005-F |
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L64005 MPEG-2 Audio/Video Decoder Technical Manual
8-5
Final Rev F
Copyright 1996 by LSI Logic Corporation. All rights reserved.
ers at the end of the PES header and writes them to the appropriate sys-
tem stream buffer.
8.2
Reading the
System Header
Data
In the PES decoding mode (when SSEL[1:0] is set to 002), the L64005
parses system header data and writes it into one of two system channel
buffers. Refer to Section 2.7, “Group 5 Control Register,” for details about
the SSEL[1:0] eld. The decoder needs two buffers when parsing a
transport stream so that the audio and video system header data does
not get mixed up with data received from different streams. An external
microprocessor may read these buffers on demand and perform any
additional parsing. Use the DRAM read-through interface to read the
buffers.
In the system (MPEG-1) or Program (MPEG-2) decoding mode (when
SSEL[1:0] is set to 012), both audio and video headers are stored in the
audio PES Buffer. This is because the decoder always receives either a
complete audio or a complete video packet, and there is no possibility of
mixing the packets.
The presence of the start code indicates the beginning of each header
to the external controller. The data that follows the header conforms to
MPEG syntax (with stufng removed from MPEG-1 packets). The last
entry of packet or PES packet headers indicates the value of the elemen-
tary stream write pointer at the time the header was written. This value
allows the decoder to associate the packet header data with the elemen-
tary stream data for synchronization purposes.
Table 8.2 shows an example of a packet header structure and its asso-
ciated write pointer in the Elementary Stream.
8.2.1
System Parser
Control Bits
The following table shows the locations of the bits that control the system
parser. Refer to Chapter 2 for details.
System Parser Control Bits
Register
Stream Select
Group 5, Control Register 0
Header Interrupts
Group 4, Interrupt Register 1
Video System Write Address
Group 7, Register 32, 38, and 39
Audio System Write Address
Group 7, Register 33, 38, and 39
相關PDF資料 |
PDF描述 |
|---|---|
| L64007 | SPECIALTY CONSUMER CIRCUIT, PQFP160 |
| L64013A1 | SPECIALTY CONSUMER CIRCUIT, PQFP100 |
| L64014A | SPECIALTY CONSUMER CIRCUIT, PQFP144 |
| L64015 | SPECIALTY CONSUMER CIRCUIT, PQFP144 |
| L64020XDC | SPECIALTY CONSUMER CIRCUIT, CBGA208 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| L64010ADC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Multiplier/Accumulator |
| L64010ADCC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Multiplier/Accumulator |
| L64010ADM | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Multiplier/Accumulator |
| L64010ADMB | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Multiplier/Accumulator |
| L64010ADMC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Multiplier/Accumulator |
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