參數(shù)資料
型號： ISP1562
廠商： NXP Semiconductors N.V.
英文描述： Hi-Speed Universal Serial Bus PCI Host Controller
中文描述： 高速通用串行總線PCI主機控制器
文件頁數(shù)： 85/98頁
文件大?。?/td> 442K
代理商： ISP1562
9397 750 14223
Koninklijke Philips Electronics N.V. 2005. All rights reserved.
Product data sheet
Rev. 01 — 14 July 2005
85 of 98
Philips Semiconductors
ISP1562
USB PCI Host Controller
16.1 Timing
[1]
REQ# and GNT# are point-to-point signals. GNT# has a setup of 10 ns; REQ# has a setup of 12 ns. All others are bus signals.
Table 122: PCI clock and IO timing
Symbol
Parameter
PCI clock timing; see
Figure 7
T
cyc(PCICLK)
PCICLK cycle time
t
HIGH(PCICLK)
PCICLK HIGH time
t
LOW(PCICLK)
PCICLK LOW time
SR
PCICLK
PCICLK slew rate
SR
RST#
RST# slew rate
PCI input timing; see
Figure 8
t
su(PCICLK)bs
setup time to PCICLK
(bus signal)
t
su(PCICLK)ptp
setup time to PCICLK
(point-to-point)
t
h(PCICLK)
input hold time from PCICLK
PCI output timing; see
Figure 9
t
val(PCICLK)bs
PCICLK to signal valid delay
(bus signal)
t
val(PCICLK)ptp
PCICLK to signal valid delay
(point-to-point)
t
dZ(act)
float to active delay
t
d(act)Z
active to float delay
PCI reset timing
t
rst
reset active time after CLK
stable
Conditions
Min
Typ
Max
Unit
30
11
11
1
50
-
-
-
-
-
32
-
-
4
-
ns
ns
ns
V/ns
mV/ns
7
-
-
ns
[1]
10
-
-
ns
0
-
-
ns
2
-
11
ns
[1]
2
-
12
ns
2
-
-
-
-
28
ns
ns
1
-
-
ms
Fig 7.
PCI clock.
minimum value
0.4V
CC(I/O)
T
cyc(PCICLK)
004aaa604
t
HIGH(PCICLK)
t
LOW(PCICLK)
0.6V
CC(I/O)
0.5V
CC(I/O)
0.4V
CC(I/O)
0.3V
CC(I/O)
0.2V
CC(I/O)
相關(guān)PDF資料
PDF描述
ISP1562BE Hi-Speed Universal Serial Bus PCI Host Controller
ISP1581 Universal Serial Bus 2.0 high-speed interface device
ISP1581BD Universal Serial Bus 2.0 high-speed interface device
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參數(shù)描述
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