參數(shù)資料
型號： EVAL-ADUC7122QSPZ
廠商： Analog Devices Inc
文件頁數(shù)： 39/96頁
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描述： BOARD EVALUATION FOR ADUC7122
設(shè)計資源： EVAL-ADUC7122 Schematic
ADUC7122 Gerber Files
ADUC7122 BOM
標準包裝： 1
系列： MicroConverter® ADuC7xxx
類型： MCU
適用于相關(guān)產(chǎn)品： ADUC7122
所含物品： 板
ADuC7122
Rev. 0 | Page 44 of 96
Table 65. DACxCON MMR Bit Designations
Bit
Value
Name
Description
15:9
0
Reserved.
8
1
DACPD
DAC power-down.
Set by user to set DACOUTx to tri-state mode.
7
0
Reserved.
6
0
BYP
DAC bypass bit.
Set this bit to bypass the DAC buffer. Cleared to buffer the DAC output.
5
0
DACCLK
DAC update rate.
Set by the user to update the DAC using Timer1.
Cleared by the user to update the DAC using HCLK (core clock).
4
0
DACCLR
DAC clear bit.
Set by the user to enable normal DAC operation.
Cleared by the user to reset data register of the DAC to 0.
3
0
Reserved.
2
0
Reserved. Always clear to 0.
1:0
DACRNx
DAC range bits.
00
VREF/AGND.
01
Reserved.
10
Reserved.
11
AVDD/AGND.
Table 66. DACxDAT Registers
Name
Address
Default Value
Access
DAC0DAT
0xFFFF0584
0x00000000
R/W
DAC1DAT
0xFFFF058C
0x00000000
R/W
DAC2DAT
0xFFFF0594
0x00000000
R/W
DAC3DAT
0xFFFF059C
0x00000000
R/W
DAC4DAT
0xFFFF05A4
0x00000000
R/W
DAC5DAT
0xFFFF05AC
0x00000000
R/W
DAC6DAT
0xFFFF05B4
0x00000000
R/W
DAC7DAT
0xFFFF05BC
0x00000000
R/W
DAC8DAT
0xFFFF05C4
0x00000000
R/W
DAC9DAT
0xFFFF05CC
0x00000000
R/W
DAC10DAT
0xFFFF05D4
0x00000000
R/W
DAC11DAT
0xFFFF05DC
0x00000000
R/W
Table 67. DACxDAT MMR Bit Designations
Bit
Description
31:28
Reserved.
27:16
12-bit data for DACx.
15:12
Reserved.
11:0
Reserved.
相關(guān)PDF資料
PDF描述
EVAL-ADUC7124QSPZ BOARD EVALUATION FOR ADUC7124
ECM30DCWN CONN EDGECARD 60POS DIP .156 SLD
EVAL-ADUC7121QSPZ BOARD EVALUATION FOR ADUC7121
EVAL-ADUC7126QSPZ BOARD EVALUATION FOR ADUC7126
REC5-243.3SRWZ/H4/A CONV DC/DC 5W 9-36VIN 3.3VOUT
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參數(shù)描述
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EVAL-ADUC7129QSPZ 制造商:Analog Devices 功能描述:- Bulk
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