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參數(shù)資料
| 型號： | EVAL-ADUC7122QSPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 24/96頁 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7122 |
| 設(shè)計資源： | EVAL-ADUC7122 Schematic ADUC7122 Gerber Files ADUC7122 BOM |
| 標準包裝： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 類型： | MCU |
| 適用于相關(guān)產(chǎn)品： | ADUC7122 |
| 所含物品： | 板 |
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ADuC7122
Rev. 0 | Page 30 of 96
TEMPERATURE SENSOR
The ADuC7122 provides a voltage output from an on-chip
band gap reference proportional to absolute temperature.
This voltage output can also be routed through the front-end
ADC multiplexer (effectively, an additional ADC channel input),
facilitating an internal temperature sensor channel that measures
die temperature.
The internal temperature sensor is not designed for use as
an absolute ambient temperature calculator. It is intended for
use as an approximate indicator of the temperature of the
ADuC7122 die.
The typical temperature coefficient is 1.25 mV/°C.
ADC MMRs Interface
The ADC is controlled and configured via a number of MMRs
08
75
5-
0
17
1250
1000
1050
1100
1150
1200
–20
0
40
60
80
20
100
ADCDA
T
(
d
B)
TEMPERATURE (°C)
Figure 17. ADC Output vs. Temperature
Table 27. ADC MMRs
Name
Description
ADCCON
ADC control register. Allows the programmer to enable the ADC peripheral to select the mode of operation of the ADC (either
single-ended, pseudo differential, or fully differential mode) and to select the conversion type (see Table 28).
ADCCP
ADC positive channel selection register.
ADCCN
ADC negative channel selection register.
ADCSTA
ADC status register. Indicates when an ADC conversion result is ready. The ADCSTA register contains only one bit, ADCREADY
(Bit 0), representing the status of the ADC. This bit is set at the end of an ADC conversion generating an ADC interrupt. It is
cleared automatically by reading the ADCDAT MMR. When the ADC is performing a conversion, the status of the ADC can be
read externally via the ADCBusy pin. This pin is high during a conversion. When the conversion is finished, ADCBusy goes back low.
This information is available on P0.2 (see the General-Purpose I/O section) if enabled in the GP0CON register.
ADCDAT
ADC data result register. Holds the 12-bit ADC result, as shown Table 32.
ADCRST
ADC reset register. Resets all the ADC registers to their default value.
PGA_GN
Gain of PADC0 and PADC1.
相關(guān)PDF資料 |
PDF描述 |
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