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參數(shù)資料
| 型號： | ADSP-21992YST |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | Mixed Signal DSP Controller With CAN |
| 中文描述： | 16-BIT, 100 MHz, OTHER DSP, PQFP176 |
| 封裝： | LQFP-176 |
| 文件頁數(shù)： | 39/49頁 |
| 文件大小： | 602K |
| 代理商： | ADSP-21992YST |
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PRELIMINARY TECHNICAL DATA
This information applies to a product under development. Its characteristics and specifications are subject to change without notice. Analog
Devices assumes no obligation regarding future manufacturing unless otherwise agreed to in writing.
39
REV. PrA
For current information contact Analog Devices at (781) 937-1799
ADSP-21992
August 2002
Serial Peripheral Interface (SPI) Port—Slave Timing
Table 15
and
Figure 23
describe SPI port slave operations.
Table 15. Serial Peripheral Interface (SPI) Port—Slave Timing
Parameter
Description
Min
Max
Unit
Switching Characteristics
t
DSOE
SPISS assertion to data out active
0
6
ns
t
DSDHI
SPISS deassertion to data high impedance
0
6
ns
t
DDSPID
SCLK edge to data out valid (data out delay)
0
5
ns
t
HDSPID
SCLK edge to data out invalid (data out hold)
0
5
ns
Timing Requirements
t
SPICHS
Serial clock high period
2t
HCLK
ns
t
SPICLS
Serial clock low period
2t
HCLK
ns
t
SCK
Serial clock period
4t
HCLK
ns
t
HDS
Last SCK edge to SPISS not asserted
2t
HCLK
ns
t
SPITDS
Sequential Transfer Delay
2t
HCLK
ns
t
SDSCI
SPISS assertion to first SCK edge
2t
HCLK
ns
t
SSPID
Data input valid to SCLK edge (data input setup)
1.6
ns
t
HSPID
SCLK sampling edge to data input invalid
1.6
ns
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