參數(shù)資料
型號(hào)： ZL50119GAG
廠商： ZARLINK SEMICONDUCTOR INC
元件分類(lèi)： 通信及網(wǎng)絡(luò)
英文描述： 32, 64 and 128 Channel CESoP Processors
中文描述： SPECIALTY TELECOM CIRCUIT, PBGA324
封裝： 23 X 23 MM, 2.03 MM HEIGHT, 1 MM PITCH, PLASTIC, MS-034, BGA-324
文件頁(yè)數(shù)： 74/95頁(yè)
文件大?。?/td> 1157K
代理商： ZL50119GAG
ZL50115/16/17/18/19/20
Data Sheet
74
Zarlink Semiconductor Inc.
12.4 TDM LIU Interface Timing
The TDM Interface can be used to directly drive into a Line Interface Unit (LIU). The interface can work in this mode
with E1, DS1, J2, E3 and DS3. The frame pulse is not present, just data and clock is transmitted and received.
Table 28 shows timing for DS3, which would be the most stringent requirement.
Figure 31 - TDM-LIU Structured Transmission/Reception
Parameter
Symbol
Min.
Typ.
Max.
Units
Notes
TDM_TXCLK Period
t
CTP
t
CTH
t
CTL
t
CRP
t
CRH
t
CRL
t
PD
t
S
t
H
22.353
ns
DS3 clock
TDM_TXCLK High
6.7
ns
TDM_TXCLK Low
6.7
ns
TDM_RXCLK Period
22.353
ns
DS3 clock
TDM_RXCLK High
9.0
ns
TDM_RXCLK Low
9.0
ns
TDM_TXDATA Output Delay
3
-
10
ns
TDM_RXDATA Input Setup
6
ns
TDM_RXDATA Input Hold
3
ns
Table 28 - TDM - LIU Structured Transmission/Reception
t
PD
t
H
t
S
t
CRL
t
CRP
t
CRH
t
CTL
t
CTP
t
CTH
TDM_TXCLK
TDM_TXDATA
TDM_RXCLK
TDM_RXDATA
相關(guān)PDF資料
PDF描述
ZL50120GAG 32, 64 and 128 Channel CESoP Processors
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ZL50115 32, 64 and 128 Channel CESoP Processors
ZL50116 32, 64 and 128 Channel CESoP Processors
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