參數(shù)資料
型號(hào)： UPD784031YGK-BE9
廠商： NEC Corp.
英文描述： 16-/8-BIT SINGLE-CHIP MICROCONTROLLERS
中文描述： 16-/8-bit的單晶片微控制器
文件頁數(shù)： 64/88頁
文件大小： 464K
代理商： UPD784031YGK-BE9
64
μ
PD784031Y
(1) Read/write operation (2/2)
Parameter
Symbol
Test Conditions
MIN.
MAX.
Unit
Data setup time (to WR
↑
)
t
SODW
V
DD
= +5.0 V
±
10 %
(1.5 + n) T – 30
ns
(1.5 + n) T – 40
ns
Data hold time (from WR
↑
)
Note
t
HWOD
V
DD
= +5.0 V
±
10 %
0.5T – 5
ns
0.5T – 25
ns
WR
↑
→
ASTB
↑
delay time
t
DWST
0.5T – 12
ns
WR low-level width
t
WWL
V
DD
= +5.0 V
±
10 %
(1.5 + n) T – 30
ns
(1.5 + n) T – 40
ns
Note
The data hold time includes the time to hold V
OH1
and V
OL1
in the load condition of C
L
= 50 pF, R
L
= 4.7 k
.
Remark
T : T
CYK
(system clock cycle time)
n : the number of wait (n
≥
0)
(2) Bus hold timing
Parameter
Symbol
Test Conditions
MIN.
MAX.
Unit
HLDRQ
↑
→
float delay time
t
FHQC
(6 + a + n) T + 50
ns
HLDRQ
↑
→
HLDAK
↑
delay time
t
DHQHHAH
V
DD
= +5.0 V
±
10 %
(7 + a + n) T + 30
ns
(7 + a + n) T + 40
ns
Float
→
HLDAK
↑
delay time
t
DCFHA
1T + 30
ns
HLDRQ
↓
→
HLDAK
↓
delay time
t
DHQLHAL
V
DD
= +5.0 V
±
10 %
2T + 40
ns
2T + 60
ns
HLDAK
↓
→
active delay time
t
DHAC
V
DD
= +5.0 V
±
10 %
1T – 20
ns
1T – 30
ns
Remark
T : T
CYK
(system clock cycle time)
a : 1 in address wait, 0 in the other conditions
n : the number of wait (n
≥
0)
相關(guān)PDF資料
PDF描述
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