參數(shù)資料
型號(hào)： TSPC860XRVZQU66D
廠商： Atmel Corp.
英文描述： Integrated Communication Processor
中文描述： 綜合通信處理器
文件頁(yè)數(shù)： 80/93頁(yè)
文件大?。?/td> 1601K
代理商： TSPC860XRVZQU66D
80
TSPC860 [Preliminary]
2129B–HIREL–12/04
Notes:
1. SCL frequency is given by SCL = BrgClk_frequency/((BRG register + 3) × pre_scaler
The ratio SYNCCLK/(BRG_CLK/pre_scaler) must be greater or equal to 4/1.
Figure 73.
I
2
C Bus Timing Diagram
Table 27.
I
2
C AC Electrical Specifications – SCL > 100 kHz
Num
Characteristic
Expression
Min
Max
Unit
200
SCL Clock Frequency (SLAVE)
fSCL
0
BRGCLK/48
Hz
200
SCL Clock Frequency (MASTER)
(1)
fSCL
BRGCLK/16512
BRGCLK/48
Hz
202
Bus Free Time Between Transmissions
1/(2.2 × fSCL)
–
s
203
LOW Period of SCL
1/(2.2 × fSCL)
–
s
204
HIGH Period of SCL
1/(2.2 × fSCL)
–
s
205
START Condition Setup Time
1/(2.2 × fSCL)
–
s
206
START Condition Hold Time
1/(2.2 × fSCL)
–
s
207
DATA Hold Time
0
–
s
208
DATA Setup Time
1/(40 × fSCL)
–
s
209
SDL/SCL Rise Time
–
1/(10 × fSCL)
s
210
SDL/SCL Fall Time
–
1/(33 × fSCL)
s
211
STOP Condition Setup Time
1/2(2.2 × fSCL)
–
s
202
SDA
SCL
203
204
205
207
208
209
206
210
211
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