參數(shù)資料
型號： TSPC860XRVZQU66D
廠商： Atmel Corp.
英文描述： Integrated Communication Processor
中文描述： 綜合通信處理器
文件頁數(shù)： 62/93頁
文件大?。?/td> 1601K
代理商： TSPC860XRVZQU66D
62
TSPC860 [Preliminary]
2129B–HIREL–12/04
Figure 49.
IDMA External Requests Timing Diagram
Figure 50.
SDACK Timing Diagram – Peripheral Write, TA Sampled Low at the Falling Edge of the Clock
Table 16.
IDMA Controller AC Electrical Specifications
Num
Characteristic
All Frequencies
Unit
Min
Max
40
DREQ Setup Time to Clock High
7
–
ns
41
DREQ Hold Time from Clock High
3
–
ns
42
SDACK Assertion Delay from Clock High
–
12
ns
43
SDACK Negation Delay from Clock Low
–
12
ns
44
SDACK Negation Delay from TA Low
–
20
ns
45
SDACK Negation Delay from Clock High
–
15
ns
46
TA Assertion to Falling Edge of the Clock Setup Time (applies to external TA)
7
–
ns
40
41
CLKO
(OUTPUT)
DREQ
(INPUT)
SDACK
CLKO
(OUTPUT)
TS
(OUTPUT)
RD/WR
(OUTPUT)
DATA
TA
(OUTPUT)
42
43
46
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