參數(shù)資料
型號： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 557/784頁
文件大小： 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
557
Agere Systems Inc.
22 Cross Connect (XC) Block Functional Description
(continued)
22.5.1 DS1/E1 Connectivity Matrix
DS1/E1 signal connectivity matrix Table 626 below is a subset of
Table 625
excluding the last row and column.
Table 626. DS1/E1 Signal Connectivity Matrix
Note:
See Table 625 for symbol and footnote descriptions.
1. Framer, M13, and VT mapper have limited self-loopback capability (no reordering).
2. RAI paths and frame sync paths supported.
3. Framer also has limited test-pattern capability.
4. AUTO AIS paths (fast AIS) supported. PTRADJ paths supported.
5. PTRADJ paths supported.
6. Jitter attenuator reordering or cascading (chaining) not expected.
7. Reference clock sources from DJA used by TPG.
Each box represents a set of 28 or more output bundles from the cross connect (XC) block. A bundle consists of
three standard data path signals [normally DATA, CLK, and FS or STFREQ], plus, in many cases, AUTO AIS, and,
in some cases, RAI or PTRADJ signals.
22.5.2 DS1/E1 Register Definition
For every valid output signal (bundle) from the cross connect, one input signal (bundle) to the cross connect is
steered to the destination, first via a block select (one of 8) and then via a channel select (one of 28, except exter-
nal I/O, which is one of 29). Therefore, each box in
Table 626
also represents thirty-two 8-bit source identifiers in
the register map.
Note:
By specifying on a per-output basis, collisions are avoided and broadcast/multicast options are preserved
(i.e., multiple outputs may share the same source identifier). For E1 signals, only 3 out of 4 channels are
used (channel numbers that are even multiples of four are typically disallowed).
The crosspoint’s connectivity is determined by a set of source identifiers (SOURCE_IDs), one for each channel
leaving the crosspoint switch. A DS1/E1 (XC1) SOURCE_ID is therefore defined as follows:
Destination
Source
External I/O
Framer TP_T
Framer RP_T
Framer TS
M13 MUX
VT Mapper
Jitter Attenuation
TPG
External
I/O
&
%
%
%
%
Framer
RP_R
%
T &
X
X
Framer
TP_R
%
X
T &
X
X
Framer
RS
%
X
X
T &
X
M13
Mapper
%
%
X
X
VT
Mapper
%
Jitter
Attenuation
%
%
%
X
TPM
T
%
2
%
X
%
T
3
T
X
T
%
4
X
1
&
%
%
4
%
%
2, 4
J
T
%
X
X
1
&
J
T
%
4, 5
T
J
T
J
T
X
X
J
T
X
6
T
J T
7
SELF
Bit
7
6
5
4
3
2
1
0
SOURCE_ID
SOURCE_BLOCK[2:0]
CHANNEL_ID[4:0]
相關PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關代理商/技術參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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