參數(shù)資料
型號： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 471/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
471
Agere Systems Inc.
20 M13/M23 MUX/DeMUX Block Functional Description
(continued)
20.7.3 Overhead Bit Generation (GR-499)
For testing purposes the F bits, M bits, and P bits can be generated with errors. The frame alignment signal (F-bit
pattern that is normally 1001) is generated with the last bit inverted (1000) if M13_DS3_FINV (
Table 288 on
page 223
) is set. The multiframe alignment signal (M-bit pattern that is normally 010) is generated as (011) if
M13_DS3_MINV (
Table 288
) is set.
The parity bits (P bits) are generated as odd rather than the normal even parity if M13_DS3_PINV (
Table 288
) is
set. Both P bits within the first DS3 frame after a 0 to 1 transition of SMPR_BER_INSRT (
Table 75 on page 68
) are
also inverted if M13_DS3_P_BERy (
Table 289 on page 224
) is set to 1.
The X bits are set to the inverse of the remote alarm indication (RAI) bit (GR-499) M13_DS3_RAI_SEND
(
Table 289
).
C-bit transmission is a function of whether the M13 MUX/deMUX is in the M23 mode or the C-bit parity mode.
20.7.4 M23 Mode
Please refer to M13_M23_CBP = 1 in
Table 272 on page 219
.
The information bits in the DS3 frame are drawn
from the 7 DS2 select blocks. If M13_M23CLK_MODE = 0 (
Table 288 on page 223
) and a select block is in the
loopback or direct DS2 input state, the selected DS2 must be synchronized to the DS3 frame generation clock. To
do this, the M13 contains seven DS2 FIFOs each with a depth of 8. The fill level of each FIFO determines the need
for bit stuffing its DS2 input.
When M13_M23CLK_MODE = 0 and DS2 select blocks are not in the loopback or direct DS2 input state, the
selected DS2s are generated using the DS3 frame generation clock. In this case, a fixed stuffing ratio is used for
the DS2s in order to produce a nominal 6.312 MHz DS2 clock rate.
When M13_M23CLK_MODE = 1, the FIFOs are not used and DS2 stuff request inputs (XC_DS2STFREQ[7—1])
will determine when stuff bits are needed.
The three C bits in each M-subframe of the DS3 frame are stuff indication bits. If the stuff opportunity bit in an M
subframe is filled by a DS2 bit, the first and second C bits in that M-subframe are transmitted as zeros. If the stuff
opportunity bit in an M-subframe is filled with a stuff bit, the first and second C bits in that M-subframe are transmit-
ted as ones.
The third C bit in each M-subframe is normally transmitted with the same value as the first and second C bits. How-
ever, if M13_DS2_LB_REQy = 1 (
Table 293 on page 225
), the third C bit is transmitted as the inverse of the first
two C bits (which indicates a loopback request for DS2 channel y).
20.7.5 C-Bit Parity Mode
Please refer to M13_M23_CBP = 0 in
Table 272 on page 219
.
The M23 MUX can operate in the C-bit parity mode
under the following two circumstances:
I
When M13_M23CLK_MODE = 0 and 28 DS1 or 21 E1 signals are being MUXed into the DS3.
I
When M13_M23CLK_MODE = 1 and 7 DS2 signals are being MUXed into the DS3.
In the C-bit parity mode, every DS2 stuffing opportunity is filled with a stuff bit. Because stuffing is not used for syn-
chronization, the selected DS2s cannot come directly from the M13 inputs, and the selected DS2s cannot be
looped back from the M23 demultiplexer. The 21 C bits in each DS3 frame are not required as stuffing indicators.
Their use is described in
Table 587 on page 472
.
相關PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關代理商/技術參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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