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參數(shù)資料
| 型號： | TFRA28J133BAL-1 |
| 元件分類： | TVS-瞬態(tài)抑制二極管 |
| 英文描述： | Transient Voltage Suppressor Diodes |
| 中文描述： | 電信提供商/數(shù)據(jù)通信 |
| 文件頁數(shù)： | 462/784頁 |
| 文件大小： | 10831K |
| 代理商： | TFRA28J133BAL-1 |
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
462
Agere Systems Inc.
20 M13/M23 MUX/DeMUX Block Functional Description
Table of Contents
Contents
Page
20 M13/M23 MUX/DeMUX Block Functional Description ....................................................................................462
20.1 M13 Introduction.......................................................................................................................................463
20.2 Features...................................................................................................................................................463
20.2.1 M13 Applications .......................................................................................................................... 463
20.3 Block Diagrams........................................................................................................................................464
20.4 M13 Functional Description......................................................................................................................467
20.5 M13 Multiplexing Path..............................................................................................................................467
20.5.1 M12 Multiplexers ........................................................................................................................... 467
20.5.2 DS1/E1 Interface .......................................................................................................................... 467
20.5.3 Loopback Select ........................................................................................................................... 468
20.5.4 DS1/E1 FIFOs .............................................................................................................................. 468
20.6 DS2 Frame Generation............................................................................................................................468
20.6.1 DS1 Mode ..................................................................................................................................... 468
20.6.2 E1 Mode ....................................................................................................................................... 469
20.7 M23 Multiplexer........................................................................................................................................470
20.7.1 DS2 Interface ................................................................................................................................ 470
20.7.2 DS2 Select Logic .......................................................................................................................... 470
20.7.3 Overhead Bit Generation (GR-499) .............................................................................................. 471
20.7.4 M23 Mode .................................................................................................................................... 471
20.7.5 C-Bit Parity Mode .......................................................................................................................... 471
20.7.6 FEAC ............................................................................................................................................ 472
20.7.7 FEBE ............................................................................................................................................ 473
20.7.8 Terminal-to-Terminal Path Maintenance Data Link ...................................................................... 473
20.8 AIS/Idle Insertion......................................................................................................................................474
20.9 B3ZS Encoder (GR-499)..........................................................................................................................474
20.10 DS3 R-to-T Loopback.............................................................................................................................475
20.10.1 DS3 Transmit Path Interface ....................................................................................................... 475
20.11 M13/M23 Demultiplexer .........................................................................................................................475
20.11.1 DS3 LOC and LOS ..................................................................................................................... 475
20.11.2 DS3 T-to-R Loopback ................................................................................................................. 476
20.11.3 M23 Demultiplexer ...................................................................................................................... 476
20.11.4 M12 Demultiplexers .................................................................................................................... 479
20.11.5 DS1 Mode ................................................................................................................................... 480
20.11.6 E1 Mode ..................................................................................................................................... 480
20.11.7 Output Select Logic .................................................................................................................... 481
Figures
Page
Figure 48. M13 Block Diagram..............................................................................................................................464
Figure 49. M12 Functional Block Diagram ............................................................................................................465
Figure 50. M23 Functional Block Diagram ............................................................................................................466
Figure 51. DS3 NSMI Transmit Operation.............................................................................................................469
Figure 52. DS3 NSMI Receive Operation..............................................................................................................469
Tables
Page
Table 587. C-Bit Parity Description and Transmit Value........................................................................................472
相關PDF資料 |
PDF描述 |
|---|---|
| TN0200T-T1 | CA DUAL BANANA/DUAL BANANA 5' |
| TN0201T-T1 | TRANSISTOR SOT23 SMD MOSFET |
| TN0520N3 | TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92 |
| TN0524N3 | TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92 |
| TN0540N3 | TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| TFRA84J13 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J131BL-3-DB | 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA |
| TFRA84J13DS0 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J13DS1 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J13DS2 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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