參數資料
型號： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數據通信
文件頁數： 25/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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25
Agere Systems Inc.
Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
3 Pin Information
(continued)
3.3.8 Low-Order Path Overhead Access Channel
Each VT has a low-order path overhead, and this interface allows access to all LOPOH bits for all VTs. Note that
the purpose of doing this is slightly different from the transport and path overhead access. These are used to cross
couple the bits between links in a protection scheme, rather than provide access for examination or modification of
the overhead, although that is possible too.
Table 11. Low-Order Path Overhead Access Channel
Figure 4. DS1/E1 to DXC Block Diagram
Pin
E17
Symbol
RCBCLK
Type
—
I/O
O
Description
Receive C-Bit Clock.
A gapped clock (nominally 93.983 kHz) for
outputting selected C bits on RCD.
Receive C-Bit Data.
The received network requirements bit (C2)
and the received unused C bits (C4, C5, C6, C16, C17, C18, C19,
C20, and C21) are output after they are demultiplexed from the
received DS3 signal.
Receive Data Link Clock.
A gapped clock (nominally 28.195 kHz)
for outputting path maintenance data link C bits on RDLD.
Receive Data Link Data.
The received path maintenance data link
C bits (C13, C14, and C15) that are demultiplexed from the received
DS3 signal.
E15
RCBDATA
—
O
E19
RDLCLK
—
O
H22
RDLDATA
—
O
Pin
Symbol
Type
I/O
Description
Transmit Direction
I Pull-down
6.48 MHz Low-Order Path Overhead Clock.
I Pull-down
Low-Order Path Overhead Data.
(O bits, V5, J2,
Z6/N2, Z7, and K4 byte.)
I Pull-down
Valid LOPOH_DATA.
Receive Direction
O
6.48 MHz Low-Order Path Overhead Clock.
O
Low-Order Path Overhead Data.
(O bits,V5, J2,
Z6/N2, and Z7/K4 byte.)
O
Valid VTMPR_LOPOH_DATA Output.
AC13
AC14
LOPOHCLKIN
LOPOHDATAIN
—
—
AB14
LOPOHVALIDIN
—
AB15
AB17
LOPOHCLKOUT
LOPOHDATAOUT
—
—
AB18
LOPOHVALIDOUT
—
Table 10. M13 Multiplexer/Demultiplexer Receive Section
(continued)
VT MAPPER
VT MAPPER
LOPOH
OUTPUTS
LOPOH
INPUTS
LOPOH
OUTPUTS
LOPOH
INPUTS
TELECOM BUS
DS1/E1 TO DXC
相關PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關代理商/技術參數
參數描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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