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參數(shù)資料
| 型號： | ST52T301P |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | 8-Bit OTP/EPROM DuaLogic] MCUs WITH ADC, UART, TIMER, TRIAC & PWM DRIVER |
| 中文描述： | 8位檢察官辦公室/存儲器DuaLogic]與藝術(shù)發(fā)展局和UART，定時器，可控硅控制器 |
| 文件頁數(shù)： | 10/100頁 |
| 文件大?。?/td> | 497K |
| 代理商： | ST52T301P |
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Figure2.5.Input Registers Bench description
2.2.2 Input Registers Bench
The Input Registers(IR)benchconsists of 11 8-bit
registers containing data or status of the
peripherals.
Alltheregisterscanbespecifiedbyusinga decimal
address,e.g.0 identifiesthe first registerof the IR.
The first four registers (ADC_OUT_0:3) of the IR
are dedicated to the 4 converted values coming
from the ADC.
TMR_OUT registers contains the current counted
value by the internal Timer; whereas TMR_ST is
the Timer
pleaserefer to Timer description.
Data read by the Parallel I/O Port are stored
automaticallyin the 6-th register, INP_PORT.
Data read by the SCI are stored automatically in
the7-th registerSCI_INand SCIstatusis storedin
the SCI_ST register. For details about SCI_ST,
pleasereferto SCI description.
TheFuzzyCorewritesthecomputedoutputvalues
in the FUZZY_OUT_0:1registers.
status. For details about TMR_ST,
10/99
ST52T301/E301
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