參數(shù)資料
型號： PXA270
廠商： Intel Corp.
英文描述： Electrical, Mechanical, and Thermal Specification
中文描述： 電氣，機械和熱規(guī)格
文件頁數(shù)： 77/126頁
文件大小： 1563K
代理商： PXA270
Electrical, Mechanical, and Thermal Specification
6-13
Intel PXA270 Processor
AC Timing Specifications
Table 6-15. SDRAM Interface AC Specifications (Sheet 1 of 2)
Symbols
Parameters
VCC_MEM =
1.8V +20% / –5%
3
VCC_MEM =
2.5V +/- 10%
4
VCC_MEM =
3.3V +/- 10%
5
Units
N
MIN
TYP
MAX
MIN
TYP
MAX
MIN
TYP
MAX
tsdCLK
SDCLK1, SDCLK2
period
9.6
—
76.9
9.6
—
76.9
9.6
—
76.9
ns
1,
2
tsdCMD
nSDCAS,
nSDRAS, nWE,
nSDCS assert time
1
—
1
1
—
1
1
—
1
SDCLK
—
tsdCAS
nSDCAS to
nSDCAS assert
time
2
—
—
2
—
—
2
—
—
SDCLK
—
tsdRCD
nSDRAS to
nSDCAS assert
time
1
MDCNFG
[DTCx]
3
1
MDCNFG
[DTCx]
3
1
MDCNFG
[DTCx]
3
SDCLK
6
tsdRP
nSDRAS Pre
charge
2
MDCNFG
[DTCx]
3
2
MDCNFG
[DTCx]
3
2
MDCNFG
[DTCx]
3
SDCLK
6
tsdCL
nSDRAS to
nSDCAS delay
2
MDCNFG
[DTCx]
3
2
MDCNFG
[DTCx]
3
2
MDCNFG
[DTCx]
3
SDCLK
6
tsdRAS
nSDRAS active
time
3
MDCNFG
[DTCx]
7
3
MDCNFG
[DTCx]
7
3
MDCNFG
[DTCx]
7
SDCLK
6
tsdRC
nSDRAS cycle
time
4
MDCNFG
[DTCx]
11
4
MDCNFG
[DTCx]
11
4
MDCNFG
[DTCx]
11
SDCLK
6
tsdWR
write recovery time
(time from last data
in the
PRECHARGE)
2
—
2
2
—
2
2
—
2
SDCLK
—
tsdSDOS
MA<24:10>,
MD<31:0>,
DQM<3:0>,
nSDCS<3:0>,
nSDRAS,
nSDCAS, nWE,
nOE, SDCKE1,
RDnWR output
setup time to
SDCLK<2:1> rise
TBD
—
—
TBD
—
TBD
—
—
ns
—
tsdSDOH
MA<24:10>,
MD<31:0>,
DQM<3:0>,
nSDCS<3:0>,
nSDRAS,
nSDCAS, nWE,
nOE, SDCKE1,
RDnWR output
hold time from
SDCLK<2:1> rise
TBD
—
—
TBD
—
TBD
—
—
ns
—
VCC_CORE = 0.85 V +/–
10%, with 1.71 V<=
VCC_MEM <= 3.63 V
VCC_CORE = 1.1 V +/–
10%, with 1.71 V <=
VCC_MEM <= 3.63 V
VCC_CORE = 1.3 V +/–
10%, with 1.71 V <=
VCC_MEM <= 3.63 V
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