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參數(shù)資料
| 型號(hào)： | PXA270 |
| 廠商： | Intel Corp. |
| 英文描述： | Electrical, Mechanical, and Thermal Specification |
| 中文描述： | 電氣，機(jī)械和熱規(guī)格 |
| 文件頁數(shù)： | 109/126頁 |
| 文件大?。?/td> | 1563K |
| 代理商： | PXA270 |
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Electrical, Mechanical, and Thermal Specification
6-45
Intel PXA270 Processor
AC Timing Specifications
Table 6-24. Timing Specification SSP Slave Mode Transmitting Data to External Peripheral
Figure 6-31. Timing Diagram for SSP Slave Mode Receiving Data from External Peripheral
Table 6-25. Timing Specification for SSP Slave Mode Receiving Data from External Peripheral
6.7
JTAG Boundary Scan Timing Specifications
Table 6-26
shows the AC specifications for the JTAG boundary-scan test-signals.
Figure 6-32
shows the timing diagram.
Parameter
Description
Min
Typ
Max
Units
tSFRM2TXD_output_delay
Frame to TX Data Out
10.58
ns
tSCLK2TXD_output_delay
Clock to Tx Data Out
10.52
ns
Parameter
Description
Min
Typical
Max
Units
tSFRM_input_delay
Frame to Rx Data Capture
5.21
ns
tSCLK_input_delay
Clock to Rx Data Capture
5.04
ns
tRXD_input_delay
Rx Data Setup to Capture
4.81
ns
PXA27 processor receiving data
(from Peripheral)
(from Peripheral)
(from Peripheral)
PXA27x SSP (Slave Mode receiving data from external peripheral
Data Capture
tSCLK_input_delay
tSFRM_input_delay
tRXD_input_delay
Data Capture
SSPSCLK
SSPRXD
SSPSFRM
Table 6-26. Boundary Scan Timing Specifications (Sheet 1 of 2)
Symbol
Parameter
Min
Max
Units
Notes
TBSF
TCK Frequency
0.0
33.33
MHz
—
TBSCH
TCK High Time
15.0
—
ns
Measured at 1.5 V
TBSCL
TCK Low Time
15.0
—
ns
Measured at 1.5 V
TBSCR
TCK Rise Time
—
5.0
ns
0.8 V to 2.0 V
TBSCF
TCK Fall Time
—
5.0
ns
2.0 V to 0.8 V
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