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參數資料
| 型號： | PPC405EZ-CSAfffTx |
| 廠商： | Applied Micro Circuits Corp. |
| 英文描述： | PowerPC 405EZ Embedded Processor |
| 中文描述： | 嵌入式處理器的PowerPC 405EZ |
| 文件頁數： | 50/54頁 |
| 文件大?。?/td> | 362K |
| 代理商： | PPC405EZ-CSAFFFTX |
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PPC405EZ – PowerPC 405EZ Embedded Processor
50
AMCC Proprietary
Revision 1.27 - August 22, 2007
Preliminary Data Sheet
Table 16. I/O Specifications—416 MHz CPU
Notes:
1. PerClk rising edge at package pin with a 10pF load trails the internal PLB clock by approximately 0.8ns.
2. I/O H is specified at 2.4 V and I/O L is specified at 0.4 V.
Signal
Input (ns)
Output (ns)
Output Current (mA)
I/O H
(minimum)
Clock
Notes
Setup Time
(T
IS
min)
Hold Time
(T
IH
min)
Valid Delay
(T
OV
max)
Hold Time
(T
OH
min)
I/O L
(minimum)
External Peripheral Interface
PerClk
CRAM_Clk
na
na
na
na
19.1
19.1
8.7
8.7
na
na
CRAM_AdV
na
na
7.2
2
19.1
8.7
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerClk/
CRAM_Clk
PerAddr04:31
na
na
7.35
2.16
19.1
8.7
BusReq
na
na
7.3
2.1
19.1
8.7
PerCS0:7
na
na
7.3
2.1
19.1
8.7
PerData00:31
1.6
2.1
7.5
2.1
19.1
8.7
HoldReq
1.6
2.1
na
na
na
na
HoldAck
na
na
7.3
2.1
19.1
8.7
HoldPri
1.6
2.1
na
na
na
na
PerOE
na
na
7.35
2.15
19.1
8.7
PerReady
1.6
2.1
na
na
na
na
PerRW
na
na
7.35
2.15
19.1
8.7
PerWBE0:3
na
na
7.3
2.15
19.1
8.7
NFALE
7.1
0.9
19.1
8.7
NFCE0
7.1
0.9
19.1
8.7
NFCLE
7.1
0.9
19.1
8.7
NFData0:7
9.2
-0.7
7.1
0.9
19.1
8.7
NFRB
10
0
19.1
8.7
NFRE
7.1
0.9
19.1
8.7
NFWE
7.1
0.9
19.1
8.7
DMAAck
DMAEOT/TC
DMAReq
na
na
7.3
2.1
19.1
19.1
19.1
8.7
8.7
8.7
5
0.9
na
na
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PDF描述 |
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