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參數(shù)資料
| 型號(hào)： | PM73122 |
| 廠商： | PMC-Sierra, Inc. |
| 英文描述： | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| 中文描述： | 32鏈接消費(fèi)電子展/ DBCES AAL1 SAR處理器 |
| 文件頁(yè)數(shù)： | 411/489頁(yè) |
| 文件大?。?/td> | 4416K |
| 代理商： | PM73122 |
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RELEASED
PM73122 AAL1GATOR-32
DATASHEET
PMC-1981419
ISSUE 7
32 LINK CES/DBCES AAL1 SAR PROCESSOR
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
386
FIFO overrun/underrun errors are reported by indicating error
status in the Extract/Insert FIFO Underrun/Overrun Interrupt Status
Register with the failing link identified.
These errors result in either the SBI_DROP_INTR or
SBI_ADD_INTR output being set.
These interrupts can only be cleared by reading the FIFO
overrun/underrun register with the failing link. Only one error can be
reported at a time. However errors are latched internally so that if
multiple errors occur, any pending errors will be reported when the first
one is cleared.
When an error is detected on a link, the link must be mapped back to a
tributary to determine which tributary had an error.
If a tributary has an underrun or overrun or depth check error, the
tributary must be reset. The tributary will automatically be reset if the
DC_EN bit is set AND the SYNC_LINK bit is not set on any tributaries
in INSBI. Otherwise the tributary must be reset by the processor by
writing the INS_TRIB_CTL or EXT_TRIB_CTL register for that
tributary.
If an SBI Alarm is detected to be changed on a particular link, then the
SBI_ALARM output is set to indicate SBI alarm change.
SBI_ALRM_STAT bit associated with that link indicates the current
state of the Extract SBI ALARM signal on the SBI tributary mapped to
this link. SBI_ALRM_INTn bit is also set to indicate that the SBI alarm
state has changed on the SBI tributary mapped to this link.
This SBI_ALRM_INTn interrupt can only be cleared by reading the
SBI ALARM Interrupt register.
The ALARM bit can be inserted into a tributary by setting the
SBI_ALRM_INS bit in the SBI Insert Bus Alarm Insert Register
associated with the link mapped to that tributary.
Buffer Depths Control:
Buffer depths are controlled via the MIN_DEPTH for T1 and E1
registers, MIN_DEPTH for DS3 registers, and T1, E1, DS3 Threshold
registers.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM73122-BI | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73123 | 8 LINK CES/DBCES AAL1 SAR |
| PM73123-PI | 8 LINK CES/DBCES AAL1 SAR |
| PM73124 | 4 Link CES/DBCES AAL1 SAR |
| PM7323 | ROUTING CONTROL, MONITORING, & POLICING 200 MBPS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM73122-BI | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BIP | 制造商:PMC-Sierra 功能描述:AAL1GATOR32 EOL270906 |
| PM73122-BI-P | 制造商:PMC-Sierra 功能描述: |
| PM73123 | 制造商:PMC 制造商全稱:PMC 功能描述:8 Link CES/DBCES AAL1 SAR |
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