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參數(shù)資料
| 型號： | PM73122 |
| 廠商： | PMC-Sierra, Inc. |
| 英文描述： | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| 中文描述： | 32鏈接消費(fèi)電子展/ DBCES AAL1 SAR處理器 |
| 文件頁數(shù)： | 167/489頁 |
| 文件大?。?/td> | 4416K |
| 代理商： | PM73122 |
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RELEASED
PM73122 AAL1GATOR-32
DATASHEET
PMC-1981419
ISSUE 7
32 LINK CES/DBCES AAL1 SAR PROCESSOR
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
142
value of this code ranges from –8 (1000) to +7 (0111). A higher value than had
been output previously indicates the remote clock is running faster than the local
clock. A lower value than had been output previously indicates the remote clock
is running slower than the local clock. The AAL1_CGC uses this value to
synthesize the TL_CLK. Since the frequency synthesizers accept 8 bit input
values, the lower 4 bits will be set to zero and the upper 4 bits will receive the
SRTS nibble. The synthesizers should be set for low resolution mode by
programming the HI_RES_SYNTH register bit in the LIN_STR_MODE memory
register to zero.
Figure 63 Receive Side SRTS Support
SRTS Bit
Extraction
SRTS
Queue
Divide by 3008
4-Bit Latch
4-Bit Counter
Cell Reception
R_SRTS_CDVT
Latch
Line Clock
Frequency
Input Reference Clock Frequency
NCLK (For T1/E1 = 2.43 MHz; For T3
= 77.76 MHz
4-Bit Count
Remote SRTS
Local SRTS
Difference between
Remote SRTS and
Local SRTS
External to AAL1_CGC
11.3.3.7
Adaptive
The Adaptive block determines the appropriate line clock frequencies based on
the buffer depth received from the A1SP. Every time a cell is received on a
particular line, the Adaptive block is given the current depth of the receive buffer.
If the buffer depth is increasing, then the local line clock is running slower than
the remote line clock. If the buffer depth is decreasing, then the local line clock
is running faster than the remote line clock. Therefore, the Adaptive block will
adjust the local line clock according to the buffer depth by passing the
appropriate value to the Frequency Synthesizer.
When CDV is accounted for, the buffer depth will not only vary due to differences
in the line clock frequencies, but also due to differences in the interarrival time of
cells. In order to truly measure the difference in the remote line clock frequency
and the local line clock frequency the buffer depth needs to be filtered. The
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM73122-BI | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73123 | 8 LINK CES/DBCES AAL1 SAR |
| PM73123-PI | 8 LINK CES/DBCES AAL1 SAR |
| PM73124 | 4 Link CES/DBCES AAL1 SAR |
| PM7323 | ROUTING CONTROL, MONITORING, & POLICING 200 MBPS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM73122-BI | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BIP | 制造商:PMC-Sierra 功能描述:AAL1GATOR32 EOL270906 |
| PM73122-BI-P | 制造商:PMC-Sierra 功能描述: |
| PM73123 | 制造商:PMC 制造商全稱:PMC 功能描述:8 Link CES/DBCES AAL1 SAR |
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