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參數(shù)資料
| 型號： | PM5317-FI |
| 英文描述： | Octal 14-Bit Rail-to-Rail DACs in 16-Lead SSOP; Package: SSOP; No of Pins: 16; Temperature Range: -40°C to +85°C |
| 中文描述： | 電信提供商/數(shù)據(jù)通信 |
| 文件頁數(shù)： | 356/544頁 |
| 文件大?。?/td> | 2537K |
| 代理商： | PM5317-FI |
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PM5317 SPECTRA-9953 Telecom Standard Product Data Sheet
Release
Proprietary and Confidential to PMC-Sierra, Inc., and for its customers’ internal use.
Document No.: PMC-2000741, Issue 5
356
When Z0DEF = 1, the bytes are defined according to ITU: Z0 bytes are STS-1/STM-0 #2 to
#16 when in STM-16 interface mode and STS-1/STM-0 #2 to #64 when in STM-64 mode.
When Z0DEF = 1, the user must ensure that remaining unused bytes (non-Z0 bytes) are
inserted via TTOH ports to ensure proper transition density in these non-scrambled byte
locations.
This bit is valid for master and slave slices. For normal operation, this bit should be set to
the same value for both master and slave slices.
J0Z0INCEN
The J0 and Z0 increment enable (J0Z0INCEN) bit controls the insertion of an incremental
pattern in the section trace and Z0 growth bytes. When J0ZOINCEN is set to logic 1, the
corresponding STS-1/STM-0 path # is inserted in the J0 and Z0 bytes according to the
priority of Table 10. When J0Z0INCEN is set to logic 0, no incremental pattern is inserted.
This bit is valid for master and slave slices. For normal operation, this bit should be set to
the same value for both master and slave slices.
TRACEEN
The section trace enable (TRACEEN) bit controls the insertion of section trace in the data
stream. When TRACEEN is set to logic 1, the section trace from the Section TTTP block is
inserted in the J0 byte of STS-1/STM-0 #1 according to the priority of Table 10. When
TRACEEN is set to logic 0, the section trace from the Section TTTP block is not inserted.
This bit is only valid for master slices.
TSLDEN
The TSLD enable (TSLDEN) bit controls the insertion of section or line DCC in the data
stream. When TSLDEN is set to logic 1, the SPECTRA-9953 inserts all ones or all zeros as
selected using the TSLD_VAL bit in the SPECTRA-9953 Transmit Control Register into the
D1-D3 bytes or D4-D12 bytes of STS-1/STM-0 #1 according to the priority of Table 10.
When TSLDEN is set to logic 0, the section or line DCC is not inserted.
This bit is only valid for master slices.
TSLDTS
The TSLD Tri-state control (TSLDTS) bit controls the TSLD output port. When TSLDTS
is set to logic 1, the corresponding TSLDCLK output pin is tri-stated. When TSLDTS is set
to logic 0, the corresponding TSLDCLK pin is driven.
This bit is only valid for master slices.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM5311 | ATM/SONET Transceiver |
| PM5323-QC | |
| PM533 | Octal 12-Bit Rail-to-Rail DACs in 16-Lead SSOP; Package: SSOP; No of Pins: 16; Temperature Range: 0°C to +70°C |
| PM533DS | 12-Bit Rail-to-Rail DACs in 10-Lead DFN; Package: DFN; No of Pins: 10; Temperature Range: -40°C to +85°C |
| PM533K | Analog IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM5319 | 制造商:PMC 制造商全稱:PMC 功能描述:SONET/SDH Interface for 622 & 155 Mbit/s |
| PM5319-NGI | 制造商:PMC-Sierra 功能描述:ARROW 622 SONET/SDH INTERFACE FOR 622 and 155 MBIT/S, BGA196, LEAD FREE |
| P-M53216P | 制造商:Panasonic Industrial Company 功能描述:I.C. |
| PM5323-QC | 制造商:PMC-Sierra 功能描述: |
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