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參數(shù)資料
| 型號(hào)： | PM5317-FI |
| 英文描述： | Octal 14-Bit Rail-to-Rail DACs in 16-Lead SSOP; Package: SSOP; No of Pins: 16; Temperature Range: -40°C to +85°C |
| 中文描述： | 電信提供商/數(shù)據(jù)通信 |
| 文件頁(yè)數(shù)： | 340/544頁(yè) |
| 文件大?。?/td> | 2537K |
| 代理商： | PM5317-FI |
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PM5317 SPECTRA-9953 Telecom Standard Product Data Sheet
Release
Proprietary and Confidential to PMC-Sierra, Inc., and for its customers’ internal use.
Document No.: PMC-2000741, Issue 5
340
PUNEQI
The path payload unequipped interrupt status (PUNEQI) bit is an event indicator. PUNEQI
is set to logic 1 to indicate any change in the status of PUNEQV (equipped to unequipped or
unequipped to equipped). The interrupt status bit is independent of the interrupt enable bit.
PUNEQI is cleared to logic 0 when this register is read.
PPDII
The path payload defect indication interrupt status (PPDII) bit is an event indicator. PPDII
is set to logic 1 to indicate any change in the status of PPDIV (no defect to payload defect
or payload defect to no defect). The interrupt status bit is independent of the interrupt
enable bit. PPDII is cleared to logic 0 when this register is read.
PRDII
The path remote defect indication interrupt status (PRDII) bit is an event indicator. PRDII
is set to logic 1 to indicate any change in the status of PRDIV (no defect to RDI defect or
RDI defect to no defect). The interrupt status bit is independent of the interrupt enable bit.
PRDII is cleared to logic 0 when this register is read.
PERDII
The path enhanced remote defect indication interrupt status (PERDII) bit is an event
indicator. PERDII is set to logic 1 to indicate any change in the status of PERDIV (no
defect to ERDI defect or ERDI defect to no defect). The interrupt status bit is independent
of the interrupt enable bit. PERDII is cleared to logic 0 when this register is read.
COPERDII
The change of path enhanced remote defect indication interrupt status (COPERDII) bit is an
event indicator. COPERDII is set to logic 1 to indicate a new ERDI-P value. The interrupt
status bit is independent of the interrupt enable bit. COPERDII is cleared to logic 0 when
this register is read.
PBIPEI
The path BIP-8 error interrupt status (PBIPEI) bit is an event indicator. PBIPEI is set to
logic 1 to indicate a path BIP-8 error. The interrupt status bit is independent of the interrupt
enable bit. PBIPEI is cleared to logic 0 when this register is read.
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