參數(shù)資料
型號： PEF22554HT
廠商： INFINEON TECHNOLOGIES AG
元件分類： 數(shù)字傳輸電路
英文描述： DATACOM, FRAMER, PQFP144
封裝： GREEN, PLASTIC, LBGA-160
文件頁數(shù)： 50/700頁
文件大?。?/td> 25742K
代理商： PEF22554HT
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Data Sheet
143
Rev. 1.2, 2006-01-26
QuadFALC
TM
PEF 22554 E
Functional Description E1
E: Spare bits for international use. Access to received information through bits RSP.RS13 and RSP.RS15.
Transmission is enabled by register bits XSP.XS13 and XSP.XS15. Additionally, automatic transmission for
submultifame error indication is selectable.
S
a: Spare bits for national use. Additionally, Sa bit access through registers RSA(8:4) and XSA(8:4) is provided.
HDLC signaling in bits S
a(8:4) is selectable.
C
1 ...C4: Cyclic redundancy check bits
A: Remote alarm indication. Additionally, automatic transmission of the A-bit is selectable.
For transmit direction, contents of time slot 0 are additionally determined by the selected transparent mode.
The CRC procedure is automatically invoked when the multiframe structure is enabled. CRC errors in the received
data stream are counted by the 16-bit CRC Error Counter CEC (one error per submultiframe, maximum).
Additionally a CRC4 error interrupt status ISR0.CRC4 is generated if enabled by IMR0.CRC4.
All CRC bits of one outgoing submultiframe are automatically inverted in case a CRC error is flagged for the
previous received submultiframe. This function is enabled by bit RC0.CRCI. Setting of bit RC0.XCRCI inverts the
CRC bits before transmission to the distant end. The function of RC0.XCRCI and RC0.CRCI are logically ored.
Table 38
CRC-Multiframe Structure (E1)
Sub- Multiframe
Frame Number
Bits 1 to 8 of the Frame
12
3456
78
Multiframe
I
0
1
2
3
4
5
6
7
C
1
0
C
2
0
C
3
1
C
4
0
1
0
1
0
1
0
1
0
A
0
A
0
A
0
A
1
S
a4
1
S
a4
1
S
a4
1
S
a4
1
S
a5
1
S
a5
1
S
a5
1
S
a5
0
S
a61
0
S
a62
0
S
a6
0
S
a64
1
S
a7
1
S
a7
1
S
a7
1
S
a7
1
S
a8
1
S
a8
1
S
a8
1
S
a8
II
8
9
10
11
12
13
14
15
C
1
C
2
1
C
3
E
C
4
E
0
1
0
1
0
1
0
1
0
A
0
A
0
A
0
A
1
S
a4
1
S
a4
1
S
a4
1
S
a4
1
S
a5
1
S
a5
1
S
a5
1
S
a5
0
S
a61
0
S
a62
0
S
a63
0
S
a64
1
S
a7
1
S
a7
1
S
a7
1
S
a7
1
S
a8
1
S
a8
1
S
a8
1
S
a8
Table 39
Transmit Transparent Mode (CRC Multiframe E1)
Transmit Transparent Source for
Enabled by
Framing + CRC
A-Bit
S
a-Bits
E-Bits
–
XSP.TT0
TSWM.TSIF
TSWM.TSIS
TSWM.TRA
TSWM.TSA(8:4)
(int. gen.)
via pin XDI
1)
via pin XDI
(int. gen.)
1) Pin XDI or XSIG or XFIFO buffer (signaling controller)
XSW.XRA
2)
via pin XDI
XSW.XRA
1)
XSW. XRA
1)
via pin XDI
XSW.XRA
1)
2) Automatic transmission of the A-bit is selectable
XSW.XY0 … 4
3)
via pin XDI
XSW.XY0 … 4
2)
XSW.XY0 … 4
2)
XSW.XY0 … 4
2)
via pin XDI
3) The S
a-bit register XSA(8:4) can be used optionally
XSP.XS13/XS15
4)
via pin XDI
(int. generated)
via pin XDI
XSP.XS13/XS15
3)
XSP.XS13/XS15
3)
4) Additionally, automatic transmission of submultiframe error indication is selectable
相關(guān)PDF資料
PDF描述
PES12-42S-N0024
PESD3V3V4UK,132 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE
PF38F3050L0YUQ3A SPECIALTY MEMORY CIRCUIT, PBGA88
PFC04108.2UHKT 1 ELEMENT, 8.2 uH, GENERAL PURPOSE INDUCTOR
PFC04101.8UHKT 1 ELEMENT, 1.8 uH, GENERAL PURPOSE INDUCTOR
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
PEF22554HT V2.1 制造商:Infineon Technologies AG 功能描述:
PEF22554HTV2.1 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
PEF22554H-TV2.1 制造商:Infineon Technologies AG 功能描述:
PEF22554HT-V2.1 制造商:Infineon Technologies AG 功能描述:PEF22554HT-V2.1
PEF22554HTV3.1 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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