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參數(shù)資料
| 型號： | PEB22554 |
| 廠商： | SIEMENS AG |
| 英文描述： | ICs for Communications |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 247/397頁 |
| 文件大小： | 1987K |
| 代理商： | PEB22554 |
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PEB 22554
Functional Description T1 / J1
Semiconductor Group
247
09.98
7.7
Framer Operating Modes T1 / J1
General
Activated with bit FMR1.PMOD = 1.
PCM line bit rate
Single frame length
Framing frequency
Organization
:
:
:
:
1.544 MBit/s
193 bit, No. 1 … 193
8 kHz
24 time-slots, No. 1 … 24
with 8 bits each, No. 1 … 8 and one preceding F bit
Selection of one of the four permissible framing formats is performed by bits
FMR4.FM1/0 . These formats are:
F4
:
4-frame multiframe
F12
:
12-frame multiframe (D4)
ESF
:
Extended Superframe
F72
:
72-frame multiframe (SLC96)
The operating mode of the QuadFALC is selected by programming the carrier data rate
and characteristics, line code, multiframe structure, and signaling scheme.
The QuadFALC implements all of the standard and/or common framing structures PCM
24 (T1, 1.544 MBit/s) carriers. The internal HDLC-Controller supports all signaling
procedures including signaling frame synchronization / synthesis in all framing formats.
After RESET, the QuadFALC must be programmed with FMR1.PMOD = 1 to enable the
T1(PCM24) mode. Switching between the framing formats is done via bit FMR4.FM1/0
for the receiver and for the transmitter.
General Aspects of Synchronization
Synchronization status is reported via bit FRS0.LFA (Loss Of Frame Alignment).
Framing errors (pulse frame and multiframe) are counted by the Framing Error Counter
FEC.
Asynchronous state is reached if
2 out of 4 (bit FMR4.SSC1/0 = 00), or
2 out of 5 (bit FMR4.SSC1/0 = 01), or
2 out of 6 (bit FMR4.SSC1/0 = 10), or
4 consecutive multiframe pattern in ESF format are incorrect
(bit FMR4.SSC1/0 = 11)
.
framing bits (terminal framing or multiframing) are incorrect. If auto-mode is enabled,
counting of framing errors is interrupted.
The resynchronization procedure may be controlled by either one of the following
procedure:
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PEB22554-HT | POT 10K OHM 9MM HORZ PLA BUSHING |
| PEB2255 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PEB2256 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PEB2256E | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PEB2256HT | SPROM PROGRAMMER ZIF SOCKET |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PEB22554-HT | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:ICs for Communications |
| PEB22554HT-V1.1 | 制造商:Siemens 功能描述: |
| PEB22554HTV1.3 | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| PEB2255H-V1.1 | 制造商:Siemens 功能描述: |
| PEB2255HV1.3 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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