參數(shù)資料
型號： MT47H32M16BT-37VL:A
元件分類： DRAM
英文描述： 32M X 16 DDR DRAM, 0.5 ns, PBGA92
封裝： 11 X 19 MM, LEAD FREE, FBGA-92
文件頁數(shù)： 124/126頁
文件大?。?/td> 7045K
pdf: 09005aef8117c18e, source: 09005aef8117c192
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512MbDDR2_3.fm - Rev. H 7/05 EN
97
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512Mb: x4, x8, x16 DDR2 SDRAM
Input Slew Rate Derating
Figure 74:
Nominal Slew Rate for tDH
Notes: 1. DQS, DQS# signals must be monotonic between VIL(DC) MAX and VIH(DC) MIN.
Figure 75:
Tangent Line for tDH
Notes: 1. DQS, DQS# signals must be monotonic between VIL(DC) MAX and VIH(DC) MIN.
VSS
Hold Slew Rate
Falling Signal
Rising Signal
VREF(DC) - VIL(DC) MAX
ΔTR
=
VIH(DC) MIN -
ΔTF
=
VDDQ
VIH(AC) MIN
VIH(DC) MIN
VREF(DC)
VIL(DC)
VIL(AC) MAX
nominal
slew rate
nominal
slew rate
DC to VREF
region
DC to VREF
region
VREF(DC)
DQS#
1
DQS
1
tDH
tDS
tDH
ΔTF
ΔTR
tDS
VSS
Hold Slew Rate
tangent line [
VIH(DC) MIN - VREF(DC)]
ΔTF
=
VDDQ
VIH(AC)MIN
VIH(DC) MIN
VREF(DC)
VIL(DC) MAX
VIL(AC) MAX
tangent
DC to VREF
region
DC to VREF
region
line
nominal
line
nominal
line
Falling Signal
Hold Slew Rate
tangent line [
- VIL(DC) MAX]
ΔTR
=
Rising Signal
VREF(DC)
DQS#
1
DQS
1
tDH
tDS
tDH
ΔTF
ΔTR
tDS
相關(guān)PDF資料
PDF描述
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參數(shù)描述
MT47H32M16CC-37E 制造商:Micron Technology Inc 功能描述:
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