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參數(shù)資料
| 型號(hào)： | MB89PV980-201 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 4.2 MHz, MICROCONTROLLER, CQFP64 |
| 封裝： | 1 MM PITCH, CERAMIC, PIGGY BACK, MQFP-64 |
| 文件頁(yè)數(shù)： | 85/426頁(yè) |
| 文件大小： | 2051K |
| 代理商： | MB89PV980-201 |
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5.6 Notes on Using Timebase Timer
5.6
Notes on Using Timebase Timer
This section lists points to note when using the timebase timer.
s Notes on Using Timebase Timer
r Notes on setting bits by program
The system cannot recover from interrupt processing if the overflow interrupt request flag bit
(TBTC: TBOC) is "1" and the interrupt request enable bit is enabled (TBTC: TBIE = "1"). Always
clear the TBOF bit.
r Clearing timebase timer
In addition to being cleared by the timebase timer initialization bit (TBTC: TBR = "0"), the timer
is cleared whenever the main clock oscillation stabilization delay time is required. When the
timebase timer is selected as a count clock of the watchdog timer, clearing the timebase timer
also clears the watchdog timer.
r Using as timer for oscillation stabilization delay time
As the main clock source oscillation is stopped when the power is turned on during main-stop
mode, and during subclock mode, the timebase timer provides the oscillation stabilization delay
time after the oscillator starts.
An appropriate oscillation stabilization delay time must be selected for the type of resonator
connected to the main clock oscillator (clock generator).
Reference:
See Section 3.6.1 "Clock Generator Section".
r Notes on peripheral functions that provided a clock supply from timebase timer
In modes in which the main clock source oscillation is stopped, the timebase timer also stops,
and the counter is cleared. As the clock derived from the timebase timer restarts output from its
initial state when the timebase timer counter is cleared, the "H" level may be shorter or the "L"
level longer by a maximum of half cycle. The clock of the watchdog timer also restarts output
from its initial state. However, as the watchdog timer counter is cleared at the same time, the
watchdog timer operates in normal cycle.
Figure 5.6-1 "Effect on Buzzer Output of Clearing Timebase Timer" shows the effect on the
buzzer output of clearing the timebase timer.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB89P985PFV-101 | 8-BIT, OTPROM, 4.2 MHz, MICROCONTROLLER, PQFP64 |
| MB89983-XXX-PFM | 8-BIT, MROM, 4.2 MHz, MICROCONTROLLER, PQFP64 |
| MB89P985PFM-201 | 8-BIT, OTPROM, 4.2 MHz, MICROCONTROLLER, PQFP64 |
| MB89PV930ACF | 8-BIT, 10 MHz, MICROCONTROLLER, CQFP48 |
| MB89T627RP-SH | 8-BIT, 10 MHz, MICROCONTROLLER, PDIP64 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MB89PW625 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89R112B1QN-G-AMERE1 | 制造商:FUJITSU 功能描述: |
| MB89R112B2QN-G-AMERE1 | 制造商:FUJITSU 功能描述: |
| MB89T637R-101P-G-SH | 制造商:FUJITSU 功能描述: |
| MB89T637R-102P-G-SH-E1 | 制造商:FUJITSU 功能描述: |
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