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參數資料
| 型號： | MB89PV980-201 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 4.2 MHz, MICROCONTROLLER, CQFP64 |
| 封裝： | 1 MM PITCH, CERAMIC, PIGGY BACK, MQFP-64 |
| 文件頁數： | 49/426頁 |
| 文件大?。?/td> | 2051K |
| 代理商： | MB89PV980-201 |
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CHAPTER 4 I/O PORTS
4.3.2
Operation of Port 2
This section describes the operations of the port 2.
s Operation of Port 2
r Operation as an output port
Setting the corresponding DDR2 register bit to "1" sets a pin as an output port.
When a pin is as an output port, the output transistor is enabled. When the output latch value
is "0", the output transistor turns "ON" and an "L" level is output from the pin. When the
output latch value is "1" the transistor turns "OFF" and the pin goes to the high-impedance
state. If a pull-up is set to the output pin, the pin goes to the pull-up state when the output
latch value is "1".
Writing data to the PDR2 register stores the data in the output latch and outputs the data to
the pin.
Reading the PDR2 register returns the pin value.
r Operation as an input port
Setting the corresponding DDR2 register bit to "0" sets a pin as an input port.
When a pin is set as an input port, the output transistor is "OFF" and the pin goes to the
high-impedance state.
Writing data to the PDP2 register stores the data in the output latch but does not output the
data to the pin.
Reading the PDR2 register returns the pin value.
r Operation as a peripheral output
If a peripheral output enable bit is set to "enable", the corresponding pin becomes a
peripheral output.
As the pin value can be read even if the peripheral output is enabled, the peripheral output
value can be read via the PDR2 register.
r Operation as a peripheral input
A port pin is set as a peripheral input by setting the corresponding DDR2 register bit to "0".
Reading the PDR2 register returns the pin value, regardless of whether or not the peripheral
is using the input pin.
r Operation at reset
Resetting the CPU initializes the DDR2 register value to "0". This sets output transistors
"OFF" (pins become input ports) and sets the pins to the high-impedance state.
The PDR2 register is not initialized by a reset. Therefore, to use as output ports, the output
data must be set in the PDR2 register before setting the corresponding DDR2 register bit to
output mode.
Pin state of P27 is undetermined until the internal clock starts operation.
相關PDF資料 |
PDF描述 |
|---|---|
| MB89P985PFV-101 | 8-BIT, OTPROM, 4.2 MHz, MICROCONTROLLER, PQFP64 |
| MB89983-XXX-PFM | 8-BIT, MROM, 4.2 MHz, MICROCONTROLLER, PQFP64 |
| MB89P985PFM-201 | 8-BIT, OTPROM, 4.2 MHz, MICROCONTROLLER, PQFP64 |
| MB89PV930ACF | 8-BIT, 10 MHz, MICROCONTROLLER, CQFP48 |
| MB89T627RP-SH | 8-BIT, 10 MHz, MICROCONTROLLER, PDIP64 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MB89PW625 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89R112B1QN-G-AMERE1 | 制造商:FUJITSU 功能描述: |
| MB89R112B2QN-G-AMERE1 | 制造商:FUJITSU 功能描述: |
| MB89T637R-101P-G-SH | 制造商:FUJITSU 功能描述: |
| MB89T637R-102P-G-SH-E1 | 制造商:FUJITSU 功能描述: |
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