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參數(shù)資料
| 型號： | MB89PV980-201 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 4.2 MHz, MICROCONTROLLER, CQFP64 |
| 封裝： | 1 MM PITCH, CERAMIC, PIGGY BACK, MQFP-64 |
| 文件頁數(shù)： | 82/426頁 |
| 文件大?。?/td> | 2051K |
| 代理商： | MB89PV980-201 |
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168
CHAPTER 5 TIMEBASE TIMER
5.4
Timebase Timer Interrupt
The timebase timer can generate an interrupt request when an overflow occurs on the
specified bit of the timebase counter (for the interval timer function).
s Interrupts for Interval Timer Function
The counter counts-up on the internal count clock. When an overflow occurs on the selected
interval timer bit, the overflow interrupt request flag bit (TBTC: TBOF) is set to "1". At this time,
an interrupt request (IRQ7) to the CPU is generated if the interrupt request enable bit is enabled
(TBTC: TBIE ="1"). Write "0" to the TBOF bit in the interrupt processing routine to clear the
interrupt request. The TBOF bit is set when at the specified counter bit overflows, regardless of
the TBIE bit value.
Check:
When enabling an interrupt request output (TBIE = "1") after wake-up from a reset, always
clear the TBOF bit (TBOF = "0") at the same time.
Notes:
An interrupt request is generated immediately if the TBOF bit is "1" when the TBIE bit is
changed from disabled to enabled ("0" --> "1").
The TBOF bit is not set if the counter is cleared (TBTC: TBR = "0") at the same time as an
overflow on the specified bit occurs.
s Oscillation Stabilization Delay Time and Timebase Timer Interrupt
If the interval time is set shorter than the main clock oscillation stabilization delay time, an
interval interrupt request from the timebase timer (TBTC: TBOF = "1") is generated at the time
when the main clock mode starts operation. In this case, disable the timebase timer interrupt
when changing to a mode in which the main clock oscillation is stopped (main stop mode and
subclock mode).
s Register and Vector Table for Timebase Timer Interrupts
Reference:
See Section 3.4.2 "Interrupt Processing" for details on the operation of interrupt.
Table 5.4-1 Register and Vector Table for Timebase Timer Interrupt
Interrupt
Interrupt level settings register
Vector table address
Register
Set bit
Upper
Lower
IRQ7
ILR2(007DH)
L71 (Bit 7)
L70 (Bit 6)
FFECH
FFEDH
相關PDF資料 |
PDF描述 |
|---|---|
| MB89P985PFV-101 | 8-BIT, OTPROM, 4.2 MHz, MICROCONTROLLER, PQFP64 |
| MB89983-XXX-PFM | 8-BIT, MROM, 4.2 MHz, MICROCONTROLLER, PQFP64 |
| MB89P985PFM-201 | 8-BIT, OTPROM, 4.2 MHz, MICROCONTROLLER, PQFP64 |
| MB89PV930ACF | 8-BIT, 10 MHz, MICROCONTROLLER, CQFP48 |
| MB89T627RP-SH | 8-BIT, 10 MHz, MICROCONTROLLER, PDIP64 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MB89PW625 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89R112B1QN-G-AMERE1 | 制造商:FUJITSU 功能描述: |
| MB89R112B2QN-G-AMERE1 | 制造商:FUJITSU 功能描述: |
| MB89T637R-101P-G-SH | 制造商:FUJITSU 功能描述: |
| MB89T637R-102P-G-SH-E1 | 制造商:FUJITSU 功能描述: |
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