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參數(shù)資料
| 型號(hào)： | M68060 |
| 廠商： | Motorola, Inc. |
| 英文描述： | M68060 User Manual |
| 中文描述： | M68060用戶手冊(cè) |
| 文件頁數(shù)： | 69/416頁 |
| 文件大?。?/td> | 1451K |
| 代理商： | M68060 |
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Integer Unit
MOTOROLA
M68060 USER’S MANUAL
3-5
3.2.2.4 ALTERNATE FUNCTION CODE REGISTERS.
ters contain 3-bit function codes. Function codes can be considered extensions of the 32-bit
logical address that optionally provides as many as eight 4-Gbyte address spaces. The pro-
cessor automatically generates function codes to select address spaces for data and pro-
grams at the user and supervisor modes. Certain instructions use the SFC and DFC
registers to specify the function codes for operations.
The alternate function code regis-
3.2.2.5 PROCESSOR CONFIGURATION REGISTER.
controls the operations of the MC68060 internal pipelines and contains a software readable
revision number. The PCR is shown in Figure 3-5.
The PCR is an 32-bit register which
Bits 31–16—Identification
These bits are configured with the value which identifies this device as an MC68060.
These bits are ignored when writing to the PCR.
See
Appendix A MC68LC060
and
Appendix B MC68EC060
MC68EC060, respectively, identification field values.
for MC68LC060 and
Bits 15–8—Revision Number
Bits 15–8 contain the 8-bit device revision number. The first revision is 00000000. These
bits are ignored when writing to the PCR.
EDEBUG—Enable Debug Features
When this bit is set, the MC68060 outputs internal control information on the address bus
(A31–A0) and data bus (D31–D0) during idle bus cycles. This capability is implemented
to support debug of designs that include the MC68060. When this bit is cleared, operation
proceeds in a normal manner and no internal information is output on idle bus cycles. This
bit is cleared at reset.
Bits 6–2—Reserved by Motorola for future use and must always be zero.
DFP—Disable Floating-Point Unit
When this bit is set, the on-chip FPU is disabled and any attempt to execute a floating-
point instruction generates a line F emulator exception. When this bit is cleared, the FPU
executes all floating-point instructions. This bit is cleared at reset. Note that before this bit
is set via the MOVEC instruction, an FNOP must be executed to ensure that all floating-
point exceptions are caught and handled. This would prevent unexpected floating-point
related exceptions to be reported when the FPU is re-enabled at a later time.
ESS—Enable Superscalar Dispatch
When this bit is set, the ability of the MC68060 to execute multiple instructions per
machine cycle is enabled. When this bit is cleared, the ability to execute multiple instruc-
tions per cycle is disabled and the MC68060 operates at a slower rate with lower perfor-
mance. This bit is cleared at reset.
31
0
30
0
29
0
28
0
27
0
26
1
25
0
24
0
Figure 3-5. Processor Configuration Register
23
0
22
0
21
1
20
1
19
0
18
0
17
0
16
0
15
Revision Number
8
7
6
2
1
0
EDEBUG
Reserved
DFP ESS
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M68302FADS | MC68302 Family Application Development System |
| M68751R | 430-450MHz, 12.5V, 27W FM MOBILE RADIO |
| M68757H | SILICON MOS FET POWER AMPLIFIER, 896-941MHz, 3W FM PORTABLE RADIO |
| M68757L | SILICON MOS FET POWER AMPLIFIER, 806-870MHz, 3W, FM PORTABLE RADIO |
| M68761 | SILICON MOS FET POWER AMPLIFIER, 820-851MHz, 6W, FM MOBILE RADIO |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M68060UM/AD | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Superscalar 32-Bit Microprocessors |
| M6816 | 制造商:Tamura Corporation of America 功能描述: |
| M682-12-GY | 制造商:JAMECO VALUEPRO 功能描述:POWER CORD,6 FEET,AWG 18/3,SJT,GRAY,PIGTAIL STRIPPED&TINNED |
| M682-12-R | 制造商:JAMECO VALUEPRO 功能描述:POWER CORD,6 FEET,AWG 18/3,SJT,BLACK,PIGTAIL,UL/CSA,105degC |
| M68302ADI-PC | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MC68302 Family Application Development System |
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