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參數(shù)資料
| 型號： | M68060 |
| 廠商： | Motorola, Inc. |
| 英文描述： | M68060 User Manual |
| 中文描述： | M68060用戶手冊 |
| 文件頁數(shù)： | 262/416頁 |
| 文件大?。?/td> | 1451K |
| 代理商： | M68060 |
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MOTOROLA
M68060 USER’S MANUAL
9-1
SECTION 9
IEEE 1149.1 TEST (JTAG) AND
DEBUG PIPE CONTROL MODES
This section describes the IEEE 1149.1 test access port (normal Joint Test Action Group
(JTAG)) mode and the debug pipe control mode, which are available on the MC68060.
9.1 IEEE 1149.1 TEST ACCESS PORT (NORMAL JTAG) MODE
The MC68060 includes dedicated user-accessible test logic that is fully compliant with the
IEEE standard 1149.1-1993
Standard Test Access Port and Boundary Scan Architecture
except in the case where the JTAG architecture and the LPSTOP function interact. This
case is not formally addressed by the standard, but the MC68060 solution is transparent to
the functionality defined by the standard, has the effect of meeting full compatibility to IEEE
1149.1, and has been approved by the IEEE 1149.1 Working Group Committee.
The following description is to be used in conjunction with the supporting IEEE document
listed previously. This section includes the description of those chip-specific items that the
IEEE standard defines as required as well as those items that are specific to the MC68060
implementation.
The MC68060 JTAG test architecture implementation supports circuit board test strategies
that are based on the IEEE standard. This architecture provides access to all of the data and
control pins of the chip from the board-edge connector through the standard four pin test
access port (TAP) plus the additional optional active low TRST reset pin (see
nal Description
for a description of TRST). The test logic itself uses a static design and is
entirely independent of the system logic, except where the JTAG mode is subordinate to
another complimentary test mode
(see
9.2 Debug Pipe Control Mode
subordinate mode, the JTAG test logic is placed in reset and the TAP pins are used for alter-
nate purposes in accordance with the rules and restrictions set forth for the use of a JTAG
compliance enable pin.
Section 2 Sig-
). When placed in the
The MC68060 JTAG implementation provides the capabilities to:
1. Perform boundary scan operations to test circuit board electrical continuity,
2. Bypass the MC68060 by reducing the shift register path to a single cell,
3. Sample the MC68060 system pins during operation and transparently shift out the
result,
4. Set the MC68060 output drive pins to fixed logic values while reducing the shift register
path to a single cell, and
5. Protect the MC68060 system output and input pins from backdriving and random
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M68302FADS | MC68302 Family Application Development System |
| M68751R | 430-450MHz, 12.5V, 27W FM MOBILE RADIO |
| M68757H | SILICON MOS FET POWER AMPLIFIER, 896-941MHz, 3W FM PORTABLE RADIO |
| M68757L | SILICON MOS FET POWER AMPLIFIER, 806-870MHz, 3W, FM PORTABLE RADIO |
| M68761 | SILICON MOS FET POWER AMPLIFIER, 820-851MHz, 6W, FM MOBILE RADIO |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M68060UM/AD | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Superscalar 32-Bit Microprocessors |
| M6816 | 制造商:Tamura Corporation of America 功能描述: |
| M682-12-GY | 制造商:JAMECO VALUEPRO 功能描述:POWER CORD,6 FEET,AWG 18/3,SJT,GRAY,PIGTAIL STRIPPED&TINNED |
| M682-12-R | 制造商:JAMECO VALUEPRO 功能描述:POWER CORD,6 FEET,AWG 18/3,SJT,BLACK,PIGTAIL,UL/CSA,105degC |
| M68302ADI-PC | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MC68302 Family Application Development System |
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