參數(shù)資料
型號： EVAL-ADUC7121QSPZ
廠商： Analog Devices Inc
文件頁數(shù)： 88/96頁
文件大?。?/td> 0K
描述： BOARD EVALUATION FOR ADUC7121
設(shè)計資源： ADUC7121 Gerber Files
ADUC7121 Schematic
標(biāo)準(zhǔn)包裝： 1
系列： MicroConverter® ADuC7xxx
類型： MCU
適用于相關(guān)產(chǎn)品： ADUC7121
所含物品： 板，CD
Data Sheet
ADuC7121
Rev. B | Page 89 of 96
Table 128. T1CON MMR Bit Designations
Bit
Value
Description
31:24
8-bit postscaler.
23
Enable write to postscaler.
22:20
Reserved.
19
Postscaler compare flag.
18
T1 interrupt generation selection flag.
17
Event select bit.
Set by the user to enable time capture of an event.
Cleared by the user to disable time capture of an event.
16:12
Event select range, 0 to 16. The events are as described in the introduction to the Timers section.
11:9
Clock select.
000
Internal 32 kHz oscillator (default).
001
Core clock.
010
UCLK.
011
P0.6. of the P0.6/MRST/PLAI[2] pin.
8
Count up.
Set by the user for Timer1 to count up.
Cleared by the user for Timer1 to count down (default).
7
Timer1 enable bit.
Set by the user to enable Timer1.
Cleared by the user to disable Timer1 (default).
6
Timer1 mode.
Set by the user to operate in periodic mode.
Cleared by the user to operate in free-running mode (default).
5:4
Format.
00
Binary (default).
01
Reserved.
10
Hr:Min:Sec:Hundredths: 23 hours to 0 hour.
11
Hr:Min:Sec:Hundredths: 255 hours to 0 hour.
3:0
Prescaler.
0000
Source clock divide-by-1 (default).
0100
Source clock divide-by-16.
1000
Source clock divide-by-256.
1111
Source clock divide-by-32,768.
相關(guān)PDF資料
PDF描述
EVAL-ADUC7126QSPZ BOARD EVALUATION FOR ADUC7126
REC5-243.3SRWZ/H4/A CONV DC/DC 5W 9-36VIN 3.3VOUT
EVAL-ADUC7023QSPZ KIT DEV FOR ADUC7023 QUICK START
RPS-1K-6-250/2.0-9 HEAT SHRINK SLEEVE
ECM30DCWH CONN EDGECARD 60POS DIP .156 SLD
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