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參數(shù)資料
| 型號： | EVAL-ADUC7121QSPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 37/96頁 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR ADUC7121 |
| 設計資源： | ADUC7121 Gerber Files ADUC7121 Schematic |
| 標準包裝： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 類型： | MCU |
| 適用于相關(guān)產(chǎn)品： | ADUC7121 |
| 所含物品： | 板，CD |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁當前第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁
ADuC7121
Data Sheet
Rev. B | Page 42 of 96
Table 51. DACxCON Registers (Default Value = 0x100, Read/Write Access)
Name
Address
DAC0CON
0xFFFF0580
DAC1CON
0xFFFF0588
DAC2CON
0xFFFF05B0
DAC3CON
0xFFFF05D8
Table 52. DAC0CON MMR Bit Designations
Bit
Value
Name
Description
15:9
0
Reserved.
8
1
DACPD
DAC power-down. Set by the user to set DACOUTx to tristate mode.
7
0
DACBUF_LP
DAC buffer low power mode. Set by the user to place DAC_BUFF into a low power mode.
6
0
BYP
DAC bypass bit.
Set this bit to bypass the DAC buffer.
Cleared to buffer the DAC output.
5
0
DACCLK
DAC update rate.
Set by the user to update the DAC using Timer1.
Cleared by the user to update the DAC using HCLK (core clock).
4
0
DACCLR
DAC clear bit.
Set by the user to enable normal DAC operation.
Cleared by the user to reset data register of the DAC to 0.
3
0
Mode
Mode bit.
Set by the user to operate on DAC normal mode and turn off the interpolator clock source. Cleared by the
user to enable the interpolation mode.
2
0
Rate
Rate bit. Set by the user to enable the interpolation clock to HCLK/16. Cleared by the user to HCLK/32.
1:0
DACRNx
DAC range bits.
00
DAC range is from AGND to the internal reference.
01
EXT_REF DAC range is from AGND to the external reference. See the REFCON MMR in Table 39 for details.
10
EXT_REF DAC range is from AGND to the external reference. See the REFCON MMR in Table 39 for more
details.
11
AVDD and AGND.
Table 53. DACxDAT Registers (Default Value = 0x00000000, Read/Write Access)
Name
Address
DAC0DAT
0xFFFF0584
DAC1DAT
0xFFFF058C
DAC2DAT
0xFFFF05B4
DAC3DAT
0xFFFF05DC
Table 54. DACxDAT MMR Bit Designations
Bit
Description
31:28
Reserved.
27:16
12-bit data for DACx.
15:12
Extra bits for interpolation mode.
11:0
Reserved.
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