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參數(shù)資料
| 型號(hào)： | E-1110 |
| 英文描述： | E-1110 10/100/1000 Mbits/s Ethernet MAC preliminary technical manual 4/01 |
| 中文描述： | 電子1110 10/100/1000 Mbits /秒以太網(wǎng)MAC初步的技術(shù)手冊(cè)4 / 01 |
| 文件頁數(shù)： | 39/108頁 |
| 文件大?。?/td> | 577K |
| 代理商： | E-1110 |
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2-26
Functional Description
E110_MRXC clocks at a frequency of 25 MHz. The duty cycle can be
between 30% and 60%.
The host packet interface operates at 125 MHz and all the conguration
and control signals are synchronous to that clock.
2.3.2 Clocks for 1000 Mbits/s GMII Mode
The core uses the following clocks for 1000 Mbits/s GMII operation:
Clock from the PHY to the E-1110 core: E1110_PHY_RCLK
Clock to the PHY from the E-1110 core: E1110_PHY_TCLK
Clock from the host packet bus interface: CLK125
The E1110_PHY_RCLK and E1110_PHY_TCLK signals are
125 MHz,
±100 ppm GMII interface clocks. The data from the PHY is
received synchronously with E1110_PHY_RCLK and the data is output
to the PHY synchronously with E1110_PHY_TCLK. The
E1110_PHY_TCLK is the same clock as the input CLK125 clock.
The CLK125 signal is a 125 MHz,
±50 ppm clock used for the Gigabit
MAC and the host packet bus interface logic in the E-1110 core.
2.3.3 Clocks for 1000 Mbits/s TBI Mode
The core uses the following clocks for 1000 Mbits/s TBI operation:
Clocks from the PHY to the E-1110 core:
–
E1110_TBI_RCLK
–
E1110_TBI_RCLKN
Clock to the PHY from the E-1110 core: E1110_PHY_TCLK
Clocks from the PCS to the E-1110 core:
–
PCS_GMII_RCLK
–
PCS_TBI_TCLK
Clocks between the PCS and E-1110 cores:
–
PCS_TBI_RCLK
–
PCS_TBI_RCLKN
–
PCS_GMII_TCLK
Clock from the host packet bus interface: CLK125
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