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參數(shù)資料
| 型號： | E-1110 |
| 英文描述： | E-1110 10/100/1000 Mbits/s Ethernet MAC preliminary technical manual 4/01 |
| 中文描述： | 電子1110 10/100/1000 Mbits /秒以太網(wǎng)MAC初步的技術(shù)手冊4 / 01 |
| 文件頁數(shù)： | 102/108頁 |
| 文件大?。?/td> | 577K |
| 代理商： | E-1110 |
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E-1110 Core Pin Summary
5-3
5.2 E-1110 Core Pin Summary
Table 5.1 summarizes the E-1110 core input and output signals and their
associated clock domains. The table provides the signal names and
types for both outputs and inputs.
Table 5.1
E-1110 Core Pin Summary
Signal Name
Description
Type
Active Clock Domain
Receive Function Signals
MRX_SOP
Receive packet Start of Packet
Output
High
Clk125
MRX_DVALID
Receive packet data valid on MRX_DATA
bus.
Output
High
Clk125
MRX_DATA[7:0]
Receive packet data
Output
–
Clk125
MRX_EOP
Receive packet End of packet
Output
High
Clk125
MRX_ACK
Receive packet data acknowledge
Input
High
Clk125
MRX_ABORT
Receive Packet Abort
Input
High
Clk125
MRX_BYTE7
Byte 7 Valid Indicator
Output
High
Clk125
MRX_BCO
Broadcast Receive packet Indication
Output
High
Clk125
MRX_MCO
Multicast Receive packet Indication
Output
High
Clk125
CRCG
CRCO Output Good
Output
High
Clk125
CRCO[8:0]
CRCO output - contains the most
signicant 9 bits of the CRC of the
destination address of the received
packet.
Output
High
Clk125
ACCEPT_CRC
Accept packets with CRC errors
Input
High
Clk125
ACCEPT_RUNT
Accept short packets. (<64 bytes)
Input
High
Clk125
ACCEPT_LONG
Accept oversized packets.
(>MAX_PKT_LEN or 1518/1522 bytes)
Input
High
Clk125
ACCEPT_CTRL
Accept MAC control packets.
Input
High
Clk125
RX_STRIP_CRC
Strip CRC from the received packet.
Input
High
Clk125
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PDF描述 |
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