參數(shù)資料
型號： DSPB56362AG120
廠商： Freescale Semiconductor
文件頁數(shù)： 65/152頁
文件大小： 0K
描述： IC DSP 24BIT AUD 120MHZ 144-LQFP
標(biāo)準(zhǔn)包裝： 60
系列： DSP56K/Symphony
類型： 音頻處理器
接口： 主機接口，I²C，SAI，SPI
時鐘速率： 120MHz
非易失內(nèi)存： ROM（126 kB）
芯片上RAM： 42kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤
Overview
DSP56362 Technical Data, Rev. 4
1-2
Freescale Semiconductor
Figure 1-1 DSP56362 Block Diagram
Data Sheet Conventions
This data sheet uses the following conventions:
OVERBAR
Used to indicate a signal that is active when pulled low (For example, the RESET pin is active
when low.)
“asserted”
Means that a high true (active high) signal is high or that a low true (active low) signal is low
“deasserted”
Means that a high true (active high) signal is low or that a low true (active low) signal is high
Examples:
Signal/Symbol
Logic State
Signal State
Voltage*
PIN
True
Asserted
VIL / VOL
PIN
False
Deasserted
VIH / VOH
PIN
True
Asserted
VIH / VOH
PIN
False
Deasserted
VIL / VOL
Note: *Values for VIL, VOL, VIH, and VOH are defined by individual product specifications.
PLL
OnCE
Clock
Generator
Internal
Data
Bus
Switch
YAB
XAB
PAB
YDB
XDB
PDB
GDB
MODB/IRQB
MODC/IRQC
External
Data Bus
Switch
11
MODD/IRQD
DSP56300
12
16
24-Bit
24
18
DDB
DAB
Peripheral
Core
YM_
E
B
XM_EB
PM_
E
B
PIO_
EB
Expansion Area
SHI
JTAG
6
5
RESET
MODA/IRQA
PINIT/NMI
EXTAL
Address
Control
Data
Triple
Timer
Host
Interface
ESAI
Address
Generation
Unit
Six Channel
DMA Unit
Program
Interrupt
Controller
Program
Decode
Controller
Program
Address
Generator
Data ALU
24 24 + 56 56-bit MAC
Two 56-bit Accumulators
56-bit Barrel Shifter
Power
Mngmnt.
DRAM/SRAM
Bus
Interface
&
I - Cache
Control
External
Address
Bus
Switch
AA0456G
Memory
Expansion
Area
Program RAM/
Instruction
Cache
3072
× 24
Program ROM
30K
× 24
Bootstrap ROM
192
× 24
X Data
RAM
5632
× 24
ROM
6144
×
24
Y Data
RAM
5632
×
24
ROM
6144
× 24
CLKOUT
DAX
(SPDIF)
2
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