參數(shù)資料
型號(hào)： ARM7TDMI
廠商： LSI Corporation
英文描述： 32-Bit Advanced RISC Machines(ARM) Microprocessor Core(32位ARM微處理器內(nèi)核芯片)
中文描述： 32位先進(jìn)RISC機(jī)器公司（ARM）的微處理器核心（32位ARM的微處理器內(nèi)核芯片）
文件頁(yè)數(shù)： 168/208頁(yè)
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代理商： ARM7TDMI
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9-18
EmbeddedICE Macrocell
9.11 Debug Communication Channel
The EmbeddedICE macrocell contains a communication channel for
passing information between the target and the host debugger. This is
implemented as coprocessor 14.
The communications channel consists of a 32-bit wide Communications
Data Read register, a 32-bit wide Communications Data Write register
and a 6-bit wide Communications Control register for synchronized
handshaking between the processor and the asynchronous debugger.
These registers live in fixed locations in EmbeddedICE macrocell’s
memory map (as shown in
Table 9.1
) and are accessed from the
processor using the
MCR
and
MRC
instructions to coprocessor 14.
9.11.1 Debug Communications Control Registers
The Debug Communications Control register is read only and allows
synchronized handshaking between the processor and the debugger.
Figure 9.7
Debug Communications Control Register
The function of each register bit is described below:
0001
[31:28]
W
1
Denotes whether the Communications Data Write
register is free or not. If the Communications Data Write
register is free (W = 0) then new data may be written. If
it is not free (W = 1), then the processor must poll until
W = 0. From the debugger’s point of view, if W = 1 then
some new data has been written which may then be
scanned out.
R
0
Denotes whether there is some new data in the
Communications Data Read register. If R = 1, then there
is some new data which may be read using an MRC
instruction. If R = 0 then the Communications Data Read
31
28
27
2
1
0
0001
. . .
W
R
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