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參數(shù)資料
| 型號： | ARM7TDMI |
| 廠商： | LSI Corporation |
| 英文描述： | 32-Bit Advanced RISC Machines(ARM) Microprocessor Core(32位ARM微處理器內(nèi)核芯片) |
| 中文描述： | 32位先進(jìn)RISC機(jī)器公司（ARM）的微處理器核心（32位ARM的微處理器內(nèi)核芯片） |
| 文件頁數(shù)： | 121/208頁 |
| 文件大?。?/td> | 2420K |
| 代理商： | ARM7TDMI |
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Reset
8-11
8.5 Reset
The boundary scan interface includes a state machine controller (the
TAP controller). In order to force the TAP controller into the correct state
after power up of the device, a reset pulse must be applied to the nTRST
signal. If the boundary scan interface is to be used, nTRST must be
driven LOW, and then HIGH again. If the boundary scan interface is not
to be used, the nTRST input should be driven by the same signal as
nRESET. Note that a clock on TCK is not necessary to reset the device.
The action of reset is as follows:
1.
System mode is selected (i.e., the boundary scan chain cells do not
intercept any of the signals passing between the external system and
the core).
2.
The
IDCODE
instruction is selected. If the TAP controller is put into
the Shift-DR state and TCK is pulsed, the contents of the ID register
will be clocked out of TDO.
8.6 Pull-up Resistors
The IEEE 1149.1 standard effectively requires that TDI and TMS should
have internal pull-up resistors. In order to minimize static current draw,
these resistors are not fitted to the core. Accordingly, the 4 inputs to the
test interface (the above TDO, TDI, TMS, and TCK) must all be driven to
good logic levels to achieve normal circuit operation.
8.7 Instruction Register
The instruction register is 4 bits in length.
There is no parity bit. The fixed value loaded into the instruction register
during the Capture-IR controller state is 0b0001.
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