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參數(shù)資料
| 型號： | ARM7TDMI |
| 廠商： | LSI Corporation |
| 英文描述： | 32-Bit Advanced RISC Machines(ARM) Microprocessor Core(32位ARM微處理器內(nèi)核芯片) |
| 中文描述： | 32位先進RISC機器公司（ARM）的微處理器核心（32位ARM的微處理器內(nèi)核芯片） |
| 文件頁數(shù)： | 136/208頁 |
| 文件大?。?/td> | 2420K |
| 代理商： | ARM7TDMI |
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8-26
Debug Interface
This causes the contents of the registers to be made visible on the data
bus. These values can then be sampled and shifted out.
Note:
The above use of R0 as the base register for the
STM
instruction is for illustration only, any register could be used.
After determining the values in the current bank of registers, it may be
desirable to access the banked registers. This can only be done by
changing mode. Normally, a mode change may only occur if the core is
already in a privileged mode. However, while in debug state, a mode
change from any mode into any other mode may occur. Note that the
debugger must restore the original mode before exiting debug state.
For example, assume that the debugger had been asked to return the
state of the USER mode and FIQ mode registers, and debug state was
entered in supervisor mode.
The instruction sequence could be:
STM R0, {R0-R15}
MRS R0, CPSR
STR R0, R0
BIC R0, 0x1F
ORR R0, 0x10
MSR CPSR, R0
STM R0, {R13,R14}
ORR R0, 0x01
MSR CPSR, R0
STM R0, {R8-R14}
; Save current registers
; Save CPSR to determine current mode
; Clear mode bits
; Select user mode
; Enter USER mode
; Save register not visible before
; Select FIQ mode
; Enter FIQ mode
; Save banked FIQ registers
All these instructions are said to execute at debug speed Debug speed
is much slower than system speed since between each core clock,
33 scan clocks occur in order to shift in an instruction, or shift out data.
Executing instructions more slowly than usual is fine for accessing the
core’s state since ARM7TDMI is fully static. However, this same method
cannot be used for determining the state of the rest of the system.
While in debug state, only the following instructions may legally be
scanned into the instruction pipeline for execution:
All data processing operations, except
TEQP
All load, store, load multiple and store multiple instructions
MSR
and
MRS
相關PDF資料 |
PDF描述 |
|---|---|
| ART10012T | 28V Input, Triple Output / HYBRID - HIGH RELIABILITY RADIATION HARDENED DC/DC CONVERTER |
| ART10015T | 28V Input, Triple Output / HYBRID - HIGH RELIABILITY RADIATION HARDENED DC/DC CONVERTER |
| ART2812T | 28V Input, Triple Output / HYBRID - HIGH RELIABILITY RADIATION HARDENED DC/DC CONVERTER |
| ART28XXT | 28V Input, Triple Output / HYBRID - HIGH RELIABILITY RADIATION HARDENED DC/DC CONVERTER |
| AS115-61 | GaAs IC SP4T Non-Reflective Switch DC-2 GHz |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| ARM7TDMI_G | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Technical Reference Manual |
| ARM7TDMI-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:周立功的中文ARM7TDI文檔 |
| ARM920T | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:System-on-Chip Platform OS Processor |
| ARM940T | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:TECHNICAL REFERENCE MANUAL |
| ARM946E-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ARM946E-S Microprocessor Core with Cache technical manual 6/01 |
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