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參數(shù)資料
| 型號(hào)： | W83977CTF-AW |
| 英文描述： | PERIPHERAL (MULTIFUNCTION) CONTROLLER |
| 中文描述： | 周邊（多功能）控制器 |
| 文件頁(yè)數(shù)： | 28/161頁(yè) |
| 文件大?。?/td> | 592K |
| 代理商： | W83977CTF-AW |
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W83977EF/ CTF
PRELIMINARY
Publication Release Date: March 1999
-19 -
Revision A1
2.0 FDC FUNCTIONAL DESCRIPTION
2.1 W83977EF/CTF FDC
The floppy disk controller of the W83977EF/CTF integrates all of the logic required for floppy disk
control. The FDC implements a PC/AT or PS/2 solution. All programmable options default to
compatible values. The FIFO provides better system performance in multi-master systems. The
digital data separator supports up to 2 M bits/sec data rate.
The FDC includes the following blocks: AT interface, Precompensation, Data Rate Selection, Digital
Data Separator, FIFO, and FDC Core.
2.1.1 AT interface
The interface consists of the standard asynchronous signals: RD#, WR#, A0-A3, IRQ, DMA control,
and a data bus. The address lines select between the configuration registers, the FIFO and
control/status registers. This interface can be switched between PC/AT, Model 30, or PS/2 normal
modes. The PS/2 register sets are a superset of the registers found in a PC/AT.
2.1.2 FIFO (Data)
The FIFO is 16 bytes in size and has programmable threshold values. All command parameter
information and disk data transfers go through the FIFO. Data transfers are governed by the RQM
and DIO bits in the Main Status Register.
The FIFO defaults to disabled mode after any form of reset. This maintains PC/AT hardware
compatibility. The default values can be changed through the CONFIGURE command. The
advantage of the FIFO is that it allows the system a larger DMA latency without causing disk errors.
The following tables give several examples of the delays with a FIFO. The data are based upon the
following formula:
THRESHOLD #
×
(1/DATA/RATE) *8 - 1.5
μ
S = DELAY
FIFO THRESHOLD
MAXIMUM DELAY TO SERVICING AT 500K BPS
Data Rate
1
×
16
μ
S - 1.5
μ
S = 14.5
μ
S
2
×
16
μ
S - 1.5
μ
S = 30.5
μ
S
8
×
16
μ
S - 1.5
μ
S = 6.5
μ
S
15
×
16
μ
S - 1.5
μ
S = 238.5
μ
S
MAXIMUM DELAY TO SERVICING AT 1M BPS
Data Rate
1
×
8
μ
S - 1.5
μ
S = 6.5
μ
S
2
×
8
μ
S - 1.5
μ
S = 14.5
μ
S
8
×
8
μ
S - 1.5
μ
S = 62.5
μ
S
15
×
8
μ
S - 1.5
μ
S = 118.5
μ
S
1 Byte
2 Byte
8 Byte
15 Byte
FIFO THRESHOLD
1 Byte
2 Byte
8 Byte
15 Byte
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| W83977CTF-PW | PERIPHERAL (MULTIFUNCTION) CONTROLLER |
| W83977TF(EOL) | W83877TF plus KBC. CIR. RTC |
| W83C42 | KEYBOARD CONTROLLER |
| W83C42P | KEYBOARD CONTROLLER |
| W83C45 | Keyboard Controller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| W83977CTF-PW | 制造商:WINBOND 制造商全稱:Winbond 功能描述:WINBOND I/O |
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| W83977EF-AW | 制造商:WINBOND 制造商全稱:Winbond 功能描述:WINBOND ISA I/O |
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