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參數(shù)資料
| 型號： | UPD61052 |
| 廠商： | NEC Corp. |
| 英文描述： | MOS INTEGRATED CIRCUIT MPEG2 AUDIO/VIDEO ENCODER |
| 中文描述： | 馬鞍山集成電路MPEG2音頻/視頻編碼器 |
| 文件頁數(shù)： | 83/106頁 |
| 文件大?。?/td> | 824K |
| 代理商： | UPD61052 |
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Data Sheet S15082EJ4V0DS
83
μ
PD61051, 61052
(8)
SDRAM interface
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Unit
MCLK cycle time
t
CK
12.3
ns
MCLK high-level width
t
CH
3.5
ns
MCLK low-level width
t
CL
3.5
ns
MD31 to MD0-out hold time
t
OH
Vs MCLK
1.5
ns
MD31 to MD0-out delay time
t
OD
Vs MCLK
9
ns
MD31 to MD0 low-Z output time
t
LZ
Vs MCLK
0
ns
MD31 to MD0 high-Z output time
t
HZ
Vs MCLK
9
ns
MD31 to MD0-in setup time
t
DS
Vs MCLK
6
ns
MD31 to MD0-in hold time
t
DH
Vs MCLK
2
ns
MA13 to MA0 delay time
t
AD
Vs MCLK
9
ns
MA13 to MA0 hold time
t
AH
Vs MCLK
1.5
ns
MCLKE delay time
t
CKS
Vs MCLK
9
ns
MCLKE hold time
t
CKH
Vs MCLK
1.5
ns
Command delay time
t
CMD
Vs MCLK
9
ns
Command hold time
t
CMH
Vs MCLK
1.5
ns
ACT
→
REF/ACT command period
t
RC
12
MCLK
REF
→
REF/ACT command period
t
RC1
12
MCLK
ACT
→
PRE command period
t
RAS
12
MCLK
PRE
→
ACT command period
t
RP
12
MCLK
ACT
→
R/W command delay time
t
RCD
3
MCLK
ACT (0)
→
ACT (1) command
period
t
RRD
4
MCLK
Data-in to PRE command period
t
DPL
2
MCLK
Data-in to ACT (REF) command
period (Auto pre-charge)
t
DAL
6
MCLK
Mode register set cycle period
t
RSC
2
MCLK
Refresh Time (4096 refresh cycle)
t
REF
50
ms
Remark
REF: Refresh, ACT: Active, PRE: Pre-charge
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD61052GD-LML | MOS INTEGRATED CIRCUIT MPEG2 AUDIO/VIDEO ENCODER |
| UPD61052GD-LML-A | MOS INTEGRATED CIRCUIT MPEG2 AUDIO/VIDEO ENCODER |
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| UPD6376 | AUDIO 2-CHANNEL 16-BIT D/A CONVERTER |
| UPD7001 | 8-BIT CMOS SERIAL I/O ANALOG-TO-DIGITAL CONVERTER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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