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參數(shù)資料
| 型號： | UPD61052 |
| 廠商： | NEC Corp. |
| 英文描述： | MOS INTEGRATED CIRCUIT MPEG2 AUDIO/VIDEO ENCODER |
| 中文描述： | 馬鞍山集成電路MPEG2音頻/視頻編碼器 |
| 文件頁數(shù)： | 43/106頁 |
| 文件大?。?/td> | 824K |
| 代理商： | UPD61052 |
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Data Sheet S15082EJ4V0DS
43
μ
PD61051, 61052
(3)
Destination address register
Address
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
R/W
24H
DA16
R/W
Destination address
25H
DA15 to DA8
R/W
Destination address
26H
DA7 to DA0
R/W
Destination address
It sets Destination address. It becomes effective in case of transfer to SDRAM or instruction RAM of internal CPU.
It isn't possible to change until it cancels a transfer mode after setting a transfer mode register. It becomes a transfer
error when rewriting before canceling a transfer mode. The relation of the address of SDRAM and instruction RAM of
internal CPU is as in
Figure 3-4
and
3-5
. The addressing of SDRAM becomes a 32 address by 4-word unit (128
bytes).
Figure 3-4. Relation of Destination Address and SDRAM Address
Host CPU
interface register
24H to 26H
0 0 0 0 0 0 0
0 0 0 0 0
SDRAM address
Bank select
The μPD61051/61052
adds 0 automatically
D
D
D
D
D
D
D
D
D
A
A
A
A
A
A
A
A
A
A
A
A
A
A
A
A
A
D
D
D
D
D
D
D
D
Figure 3-5. Relation of Destination Address and Instruction ROM Address of Internal CPU
0 0 0 0 0 0 0
Instruction RAM
address of
intemal CPU
Host CPU
interface register
24H to 26H
D
D
D
D
D
D
D
D
D
A
A
A
A
A
A
A
A
A
A
A
A
A
A
A
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D
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D
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D
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD61052GD-LML | MOS INTEGRATED CIRCUIT MPEG2 AUDIO/VIDEO ENCODER |
| UPD61052GD-LML-A | MOS INTEGRATED CIRCUIT MPEG2 AUDIO/VIDEO ENCODER |
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| UPD6376 | AUDIO 2-CHANNEL 16-BIT D/A CONVERTER |
| UPD7001 | 8-BIT CMOS SERIAL I/O ANALOG-TO-DIGITAL CONVERTER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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